add [BSP]stm32f107 Kconfig
add rt_console_set_devic，components,gpio,rtc
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whj4674672
parent
ea48042fe3
commit
b8a6b1e38a
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@ -0,0 +1,372 @@
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# Automatically generated file; DO NOT EDIT.
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# RT-Thread Configuration
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#
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# RT-Thread Kernel
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CONFIG_RT_NAME_MAX=8
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CONFIG_RT_ALIGN_SIZE=4
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# CONFIG_RT_THREAD_PRIORITY_8 is not set
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CONFIG_RT_THREAD_PRIORITY_32=y
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# CONFIG_RT_THREAD_PRIORITY_256 is not set
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CONFIG_RT_THREAD_PRIORITY_MAX=32
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CONFIG_RT_TICK_PER_SECOND=1000
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CONFIG_RT_USING_OVERFLOW_CHECK=y
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CONFIG_RT_USING_HOOK=y
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CONFIG_RT_IDEL_HOOK_LIST_SIZE=4
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CONFIG_IDLE_THREAD_STACK_SIZE=256
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# CONFIG_RT_USING_TIMER_SOFT is not set
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CONFIG_RT_DEBUG=y
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# CONFIG_RT_DEBUG_INIT_CONFIG is not set
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# CONFIG_RT_DEBUG_THREAD_CONFIG is not set
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# CONFIG_RT_DEBUG_SCHEDULER_CONFIG is not set
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# CONFIG_RT_DEBUG_IPC_CONFIG is not set
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# CONFIG_RT_DEBUG_TIMER_CONFIG is not set
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# CONFIG_RT_DEBUG_IRQ_CONFIG is not set
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# CONFIG_RT_DEBUG_MEM_CONFIG is not set
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# CONFIG_RT_DEBUG_SLAB_CONFIG is not set
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# CONFIG_RT_DEBUG_MEMHEAP_CONFIG is not set
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# CONFIG_RT_DEBUG_MODULE_CONFIG is not set
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#
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# Inter-Thread communication
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#
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CONFIG_RT_USING_SEMAPHORE=y
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CONFIG_RT_USING_MUTEX=y
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|
CONFIG_RT_USING_EVENT=y
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||||||
|
CONFIG_RT_USING_MAILBOX=y
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||||||
|
CONFIG_RT_USING_MESSAGEQUEUE=y
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||||||
|
# CONFIG_RT_USING_SIGNALS is not set
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#
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|
# Memory Management
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#
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CONFIG_RT_USING_MEMPOOL=y
|
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|
CONFIG_RT_USING_MEMHEAP=y
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|
# CONFIG_RT_USING_NOHEAP is not set
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|
CONFIG_RT_USING_SMALL_MEM=y
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||||||
|
# CONFIG_RT_USING_SLAB is not set
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|
# CONFIG_RT_USING_MEMHEAP_AS_HEAP is not set
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|
# CONFIG_RT_USING_MEMTRACE is not set
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|
CONFIG_RT_USING_HEAP=y
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#
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|
# Kernel Device Object
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#
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CONFIG_RT_USING_DEVICE=y
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|
# CONFIG_RT_USING_DEVICE_OPS is not set
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|
# CONFIG_RT_USING_INTERRUPT_INFO is not set
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|
CONFIG_RT_USING_CONSOLE=y
|
||||||
|
CONFIG_RT_CONSOLEBUF_SIZE=128
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|
CONFIG_RT_CONSOLE_DEVICE_NAME="uart2"
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|
# CONFIG_RT_USING_MODULE is not set
|
||||||
|
CONFIG_ARCH_ARM=y
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||||||
|
CONFIG_ARCH_ARM_CORTEX_M=y
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|
CONFIG_ARCH_ARM_CORTEX_M3=y
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#
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|
# RT-Thread Components
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#
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|
CONFIG_RT_USING_COMPONENTS_INIT=y
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|
# CONFIG_RT_USING_USER_MAIN is not set
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|
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|
#
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|
# C++ features
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#
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|
# CONFIG_RT_USING_CPLUSPLUS is not set
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#
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|
# Command shell
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#
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CONFIG_RT_USING_FINSH=y
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|
CONFIG_FINSH_THREAD_NAME="tshell"
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|
CONFIG_FINSH_USING_HISTORY=y
|
||||||
|
CONFIG_FINSH_HISTORY_LINES=5
|
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|
CONFIG_FINSH_USING_SYMTAB=y
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|
CONFIG_FINSH_USING_DESCRIPTION=y
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|
# CONFIG_FINSH_ECHO_DISABLE_DEFAULT is not set
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|
CONFIG_FINSH_THREAD_PRIORITY=20
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|
CONFIG_FINSH_THREAD_STACK_SIZE=4096
|
||||||
|
CONFIG_FINSH_CMD_SIZE=80
|
||||||
|
# CONFIG_FINSH_USING_AUTH is not set
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|
CONFIG_FINSH_USING_MSH=y
|
||||||
|
CONFIG_FINSH_USING_MSH_DEFAULT=y
|
||||||
|
# CONFIG_FINSH_USING_MSH_ONLY is not set
|
||||||
|
CONFIG_FINSH_ARG_MAX=10
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|
#
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|
# Device virtual file system
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#
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|
CONFIG_RT_USING_DFS=y
|
||||||
|
CONFIG_DFS_USING_WORKDIR=y
|
||||||
|
CONFIG_DFS_FILESYSTEMS_MAX=2
|
||||||
|
CONFIG_DFS_FILESYSTEM_TYPES_MAX=2
|
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|
CONFIG_DFS_FD_MAX=16
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|
# CONFIG_RT_USING_DFS_MNTTABLE is not set
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|
CONFIG_RT_USING_DFS_ELMFAT=y
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#
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|
# elm-chan's FatFs, Generic FAT Filesystem Module
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#
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CONFIG_RT_DFS_ELM_CODE_PAGE=437
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|
CONFIG_RT_DFS_ELM_WORD_ACCESS=y
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|
# CONFIG_RT_DFS_ELM_USE_LFN_0 is not set
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|
# CONFIG_RT_DFS_ELM_USE_LFN_1 is not set
|
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|
# CONFIG_RT_DFS_ELM_USE_LFN_2 is not set
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|
CONFIG_RT_DFS_ELM_USE_LFN_3=y
|
||||||
|
CONFIG_RT_DFS_ELM_USE_LFN=3
|
||||||
|
CONFIG_RT_DFS_ELM_MAX_LFN=255
|
||||||
|
CONFIG_RT_DFS_ELM_DRIVES=2
|
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|
CONFIG_RT_DFS_ELM_MAX_SECTOR_SIZE=512
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|
# CONFIG_RT_DFS_ELM_USE_ERASE is not set
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|
CONFIG_RT_DFS_ELM_REENTRANT=y
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|
CONFIG_RT_USING_DFS_DEVFS=y
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|
# CONFIG_RT_USING_DFS_ROMFS is not set
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|
# CONFIG_RT_USING_DFS_RAMFS is not set
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|
# CONFIG_RT_USING_DFS_UFFS is not set
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|
# CONFIG_RT_USING_DFS_JFFS2 is not set
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|
# CONFIG_RT_USING_DFS_NFS is not set
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#
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|
# Device Drivers
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#
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CONFIG_RT_USING_DEVICE_IPC=y
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|
CONFIG_RT_PIPE_BUFSZ=512
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|
CONFIG_RT_USING_SERIAL=y
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|
# CONFIG_RT_USING_CAN is not set
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|
# CONFIG_RT_USING_HWTIMER is not set
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|
# CONFIG_RT_USING_CPUTIME is not set
|
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|
# CONFIG_RT_USING_I2C is not set
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|
CONFIG_RT_USING_PIN=y
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||||||
|
# CONFIG_RT_USING_PWM is not set
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|
# CONFIG_RT_USING_MTD_NOR is not set
|
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|
# CONFIG_RT_USING_MTD_NAND is not set
|
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|
# CONFIG_RT_USING_RTC is not set
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|
# CONFIG_RT_USING_SDIO is not set
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||||||
|
# CONFIG_RT_USING_SPI is not set
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||||||
|
# CONFIG_RT_USING_WDT is not set
|
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|
# CONFIG_RT_USING_WIFI is not set
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||||||
|
# CONFIG_RT_USING_AUDIO is not set
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||||||
|
|
||||||
|
#
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|
# Using USB
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#
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|
# CONFIG_RT_USING_USB_HOST is not set
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|
# CONFIG_RT_USING_USB_DEVICE is not set
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#
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|
# POSIX layer and C standard library
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#
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CONFIG_RT_USING_LIBC=y
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|
# CONFIG_RT_USING_PTHREADS is not set
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|
# CONFIG_RT_USING_POSIX is not set
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|
# CONFIG_RT_USING_LWP is not set
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||||||
|
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|
#
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|
# Network
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#
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|
#
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|
# Socket abstraction layer
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#
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|
# CONFIG_RT_USING_SAL is not set
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#
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# light weight TCP/IP stack
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#
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|
CONFIG_RT_USING_LWIP=y
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|
# CONFIG_RT_USING_LWIP141 is not set
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|
CONFIG_RT_USING_LWIP202=y
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|
# CONFIG_RT_USING_LWIP_IPV6 is not set
|
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|
CONFIG_RT_LWIP_IGMP=y
|
||||||
|
CONFIG_RT_LWIP_ICMP=y
|
||||||
|
# CONFIG_RT_LWIP_SNMP is not set
|
||||||
|
CONFIG_RT_LWIP_DNS=y
|
||||||
|
CONFIG_RT_LWIP_DHCP=y
|
||||||
|
CONFIG_IP_SOF_BROADCAST=1
|
||||||
|
CONFIG_IP_SOF_BROADCAST_RECV=1
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||||||
|
|
||||||
|
#
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|
# Static IPv4 Address
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|
#
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|
CONFIG_RT_LWIP_IPADDR="192.168.1.30"
|
||||||
|
CONFIG_RT_LWIP_GWADDR="192.168.1.1"
|
||||||
|
CONFIG_RT_LWIP_MSKADDR="255.255.255.0"
|
||||||
|
CONFIG_RT_LWIP_UDP=y
|
||||||
|
CONFIG_RT_LWIP_TCP=y
|
||||||
|
# CONFIG_RT_LWIP_RAW is not set
|
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|
# CONFIG_RT_LWIP_PPP is not set
|
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|
CONFIG_RT_MEMP_NUM_NETCONN=8
|
||||||
|
CONFIG_RT_LWIP_PBUF_NUM=16
|
||||||
|
CONFIG_RT_LWIP_RAW_PCB_NUM=4
|
||||||
|
CONFIG_RT_LWIP_UDP_PCB_NUM=4
|
||||||
|
CONFIG_RT_LWIP_TCP_PCB_NUM=4
|
||||||
|
CONFIG_RT_LWIP_TCP_SEG_NUM=40
|
||||||
|
CONFIG_RT_LWIP_TCP_SND_BUF=8196
|
||||||
|
CONFIG_RT_LWIP_TCP_WND=8196
|
||||||
|
CONFIG_RT_LWIP_TCPTHREAD_PRIORITY=10
|
||||||
|
CONFIG_RT_LWIP_TCPTHREAD_MBOX_SIZE=8
|
||||||
|
CONFIG_RT_LWIP_TCPTHREAD_STACKSIZE=1024
|
||||||
|
# CONFIG_LWIP_NO_RX_THREAD is not set
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||||||
|
# CONFIG_LWIP_NO_TX_THREAD is not set
|
||||||
|
CONFIG_RT_LWIP_ETHTHREAD_PRIORITY=12
|
||||||
|
CONFIG_RT_LWIP_ETHTHREAD_STACKSIZE=1024
|
||||||
|
CONFIG_RT_LWIP_ETHTHREAD_MBOX_SIZE=8
|
||||||
|
# CONFIG_RT_LWIP_REASSEMBLY_FRAG is not set
|
||||||
|
CONFIG_LWIP_NETIF_STATUS_CALLBACK=1
|
||||||
|
CONFIG_SO_REUSE=1
|
||||||
|
CONFIG_LWIP_SO_RCVTIMEO=1
|
||||||
|
CONFIG_LWIP_SO_SNDTIMEO=1
|
||||||
|
CONFIG_LWIP_SO_RCVBUF=1
|
||||||
|
# CONFIG_RT_LWIP_NETIF_LOOPBACK is not set
|
||||||
|
CONFIG_LWIP_NETIF_LOOPBACK=0
|
||||||
|
# CONFIG_RT_LWIP_STATS is not set
|
||||||
|
# CONFIG_RT_LWIP_DEBUG is not set
|
||||||
|
|
||||||
|
#
|
||||||
|
# Modbus master and slave stack
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||||||
|
#
|
||||||
|
# CONFIG_RT_USING_MODBUS is not set
|
||||||
|
|
||||||
|
#
|
||||||
|
# AT commands
|
||||||
|
#
|
||||||
|
# CONFIG_RT_USING_AT is not set
|
||||||
|
# CONFIG_LWIP_USING_DHCPD is not set
|
||||||
|
|
||||||
|
#
|
||||||
|
# VBUS(Virtual Software BUS)
|
||||||
|
#
|
||||||
|
# CONFIG_RT_USING_VBUS is not set
|
||||||
|
|
||||||
|
#
|
||||||
|
# Utilities
|
||||||
|
#
|
||||||
|
# CONFIG_RT_USING_LOGTRACE is not set
|
||||||
|
# CONFIG_RT_USING_RYM is not set
|
||||||
|
|
||||||
|
#
|
||||||
|
# ARM CMSIS
|
||||||
|
#
|
||||||
|
# CONFIG_RT_USING_CMSIS_OS is not set
|
||||||
|
CONFIG_RT_USING_RTT_CMSIS=y
|
||||||
|
|
||||||
|
#
|
||||||
|
# RT-Thread online packages
|
||||||
|
#
|
||||||
|
|
||||||
|
#
|
||||||
|
# IoT - internet of things
|
||||||
|
#
|
||||||
|
# CONFIG_PKG_USING_PAHOMQTT is not set
|
||||||
|
# CONFIG_PKG_USING_WEBCLIENT is not set
|
||||||
|
# CONFIG_PKG_USING_MONGOOSE is not set
|
||||||
|
# CONFIG_PKG_USING_WEBTERMINAL is not set
|
||||||
|
# CONFIG_PKG_USING_CJSON is not set
|
||||||
|
# CONFIG_PKG_USING_JSMN is not set
|
||||||
|
# CONFIG_PKG_USING_LJSON is not set
|
||||||
|
# CONFIG_PKG_USING_EZXML is not set
|
||||||
|
# CONFIG_PKG_USING_NANOPB is not set
|
||||||
|
|
||||||
|
#
|
||||||
|
# Wi-Fi
|
||||||
|
#
|
||||||
|
|
||||||
|
#
|
||||||
|
# Marvell WiFi
|
||||||
|
#
|
||||||
|
# CONFIG_PKG_USING_WLANMARVELL is not set
|
||||||
|
|
||||||
|
#
|
||||||
|
# Wiced WiFi
|
||||||
|
#
|
||||||
|
# CONFIG_PKG_USING_WLAN_WICED is not set
|
||||||
|
# CONFIG_PKG_USING_COAP is not set
|
||||||
|
# CONFIG_PKG_USING_NOPOLL is not set
|
||||||
|
# CONFIG_PKG_USING_NETUTILS is not set
|
||||||
|
# CONFIG_PKG_USING_AT_DEVICE is not set
|
||||||
|
|
||||||
|
#
|
||||||
|
# IoT Cloud
|
||||||
|
#
|
||||||
|
# CONFIG_PKG_USING_ONENET is not set
|
||||||
|
# CONFIG_PKG_USING_GAGENT_CLOUD is not set
|
||||||
|
# CONFIG_PKG_USING_ALI_IOTKIT is not set
|
||||||
|
|
||||||
|
#
|
||||||
|
# security packages
|
||||||
|
#
|
||||||
|
# CONFIG_PKG_USING_MBEDTLS is not set
|
||||||
|
# CONFIG_PKG_USING_libsodium is not set
|
||||||
|
# CONFIG_PKG_USING_TINYCRYPT is not set
|
||||||
|
|
||||||
|
#
|
||||||
|
# language packages
|
||||||
|
#
|
||||||
|
# CONFIG_PKG_USING_LUA is not set
|
||||||
|
# CONFIG_PKG_USING_JERRYSCRIPT is not set
|
||||||
|
# CONFIG_PKG_USING_MICROPYTHON is not set
|
||||||
|
|
||||||
|
#
|
||||||
|
# multimedia packages
|
||||||
|
#
|
||||||
|
# CONFIG_PKG_USING_OPENMV is not set
|
||||||
|
# CONFIG_PKG_USING_MUPDF is not set
|
||||||
|
|
||||||
|
#
|
||||||
|
# tools packages
|
||||||
|
#
|
||||||
|
# CONFIG_PKG_USING_CMBACKTRACE is not set
|
||||||
|
# CONFIG_PKG_USING_EASYFLASH is not set
|
||||||
|
# CONFIG_PKG_USING_EASYLOGGER is not set
|
||||||
|
# CONFIG_PKG_USING_SYSTEMVIEW is not set
|
||||||
|
|
||||||
|
#
|
||||||
|
# system packages
|
||||||
|
#
|
||||||
|
# CONFIG_PKG_USING_GUIENGINE is not set
|
||||||
|
# CONFIG_PKG_USING_CAIRO is not set
|
||||||
|
# CONFIG_PKG_USING_PIXMAN is not set
|
||||||
|
# CONFIG_PKG_USING_LWEXT4 is not set
|
||||||
|
# CONFIG_PKG_USING_PARTITION is not set
|
||||||
|
# CONFIG_PKG_USING_FAL is not set
|
||||||
|
# CONFIG_PKG_USING_SQLITE is not set
|
||||||
|
# CONFIG_PKG_USING_RTI is not set
|
||||||
|
# CONFIG_PKG_USING_LITTLEVGL2RTT is not set
|
||||||
|
|
||||||
|
#
|
||||||
|
# peripheral libraries and drivers
|
||||||
|
#
|
||||||
|
# CONFIG_PKG_USING_STM32F4_HAL is not set
|
||||||
|
# CONFIG_PKG_USING_STM32F4_DRIVERS is not set
|
||||||
|
# CONFIG_PKG_USING_REALTEK_AMEBA is not set
|
||||||
|
# CONFIG_PKG_USING_SHT2X is not set
|
||||||
|
|
||||||
|
#
|
||||||
|
# miscellaneous packages
|
||||||
|
#
|
||||||
|
# CONFIG_PKG_USING_LIBCSV is not set
|
||||||
|
# CONFIG_PKG_USING_OPTPARSE is not set
|
||||||
|
# CONFIG_PKG_USING_FASTLZ is not set
|
||||||
|
# CONFIG_PKG_USING_MINILZO is not set
|
||||||
|
# CONFIG_PKG_USING_QUICKLZ is not set
|
||||||
|
# CONFIG_PKG_USING_MULTIBUTTON is not set
|
||||||
|
# CONFIG_PKG_USING_CANFESTIVAL is not set
|
||||||
|
# CONFIG_PKG_USING_ZLIB is not set
|
||||||
|
# CONFIG_PKG_USING_DSTR is not set
|
||||||
|
|
||||||
|
#
|
||||||
|
# sample package
|
||||||
|
#
|
||||||
|
# CONFIG_PKG_USING_SAMPLES is not set
|
||||||
|
|
||||||
|
#
|
||||||
|
# example package: hello
|
||||||
|
#
|
||||||
|
# CONFIG_PKG_USING_HELLO is not set
|
||||||
|
CONFIG_SOC_STM32F1=y
|
||||||
|
# CONFIG_RT_USING_UART1 is not set
|
||||||
|
CONFIG_RT_USING_UART2=y
|
||||||
|
# CONFIG_RT_USING_UART3 is not set
|
||||||
|
|
@ -0,0 +1,36 @@
|
||||||
|
mainmenu "RT-Thread Configuration"
|
||||||
|
|
||||||
|
config $BSP_DIR
|
||||||
|
string
|
||||||
|
option env="BSP_ROOT"
|
||||||
|
default "."
|
||||||
|
|
||||||
|
config $RTT_DIR
|
||||||
|
string
|
||||||
|
option env="RTT_ROOT"
|
||||||
|
default "../.."
|
||||||
|
|
||||||
|
# you can change the RTT_ROOT default "../.." to your rtthread_root,
|
||||||
|
# example: default "F:/git_repositories/rt-thread"
|
||||||
|
|
||||||
|
config $PKGS_DIR
|
||||||
|
string
|
||||||
|
option env="PKGS_ROOT"
|
||||||
|
default "packages"
|
||||||
|
|
||||||
|
config $ENV_DIR
|
||||||
|
string
|
||||||
|
option env="ENV_ROOT"
|
||||||
|
default "/"
|
||||||
|
|
||||||
|
source "$RTT_DIR/Kconfig"
|
||||||
|
source "$PKGS_DIR/Kconfig"
|
||||||
|
|
||||||
|
|
||||||
|
config SOC_STM32F1
|
||||||
|
bool
|
||||||
|
select ARCH_ARM_CORTEX_M3
|
||||||
|
default y
|
||||||
|
|
||||||
|
source "$BSP_DIR/drivers/Kconfig"
|
||||||
|
|
||||||
|
|
@ -10,6 +10,7 @@
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* Change Logs:
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* Change Logs:
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* Date Author Notes
|
* Date Author Notes
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* 2009-01-05 Bernard the first version
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* 2009-01-05 Bernard the first version
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||||||
|
* 2018-08-17 whj remove finsh_set_device add components
|
||||||
*/
|
*/
|
||||||
|
|
||||||
/**
|
/**
|
||||||
|
|
@ -38,6 +39,11 @@ extern int lwip_system_init(void);
|
||||||
|
|
||||||
void rt_init_thread_entry(void* parameter)
|
void rt_init_thread_entry(void* parameter)
|
||||||
{
|
{
|
||||||
|
#ifdef RT_USING_COMPONENTS_INIT
|
||||||
|
/* initialization RT-Thread Components */
|
||||||
|
rt_components_init();
|
||||||
|
#endif
|
||||||
|
|
||||||
{
|
{
|
||||||
extern void rt_platform_init(void);
|
extern void rt_platform_init(void);
|
||||||
rt_platform_init();
|
rt_platform_init();
|
||||||
|
|
@ -72,11 +78,6 @@ void rt_init_thread_entry(void* parameter)
|
||||||
rt_kprintf("TCP/IP initialized!\n");
|
rt_kprintf("TCP/IP initialized!\n");
|
||||||
#endif
|
#endif
|
||||||
|
|
||||||
#ifdef RT_USING_FINSH
|
|
||||||
/* initialize finsh */
|
|
||||||
finsh_system_init();
|
|
||||||
finsh_set_device(RT_CONSOLE_DEVICE_NAME);
|
|
||||||
#endif
|
|
||||||
}
|
}
|
||||||
|
|
||||||
int rt_application_init(void)
|
int rt_application_init(void)
|
||||||
|
|
|
||||||
|
|
@ -0,0 +1,11 @@
|
||||||
|
config RT_USING_UART1
|
||||||
|
bool "Enable UART1 (PA9/10)"
|
||||||
|
default n
|
||||||
|
|
||||||
|
config RT_USING_UART2
|
||||||
|
bool "Enable UART2 (PD5/6)"
|
||||||
|
default y
|
||||||
|
|
||||||
|
config RT_USING_UART3
|
||||||
|
bool "Enable UART3 (PC10/11)"
|
||||||
|
default n
|
||||||
|
|
@ -16,6 +16,13 @@ platform.c
|
||||||
if GetDepend('RT_USING_LWIP'):
|
if GetDepend('RT_USING_LWIP'):
|
||||||
src += ['stm32_eth.c']
|
src += ['stm32_eth.c']
|
||||||
|
|
||||||
|
if GetDepend(['RT_USING_PIN']):
|
||||||
|
src += ['gpio.c']
|
||||||
|
|
||||||
|
# add Ethernet drivers.
|
||||||
|
if GetDepend('RT_USING_RTC'):
|
||||||
|
src += ['stm32f1_rtc.c']
|
||||||
|
|
||||||
if GetDepend('RT_USING_SPI'):
|
if GetDepend('RT_USING_SPI'):
|
||||||
src += ['rt_stm32f10x_spi.c']
|
src += ['rt_stm32f10x_spi.c']
|
||||||
|
|
||||||
|
|
|
||||||
|
|
@ -10,6 +10,7 @@
|
||||||
* Change Logs:
|
* Change Logs:
|
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* Date Author Notes
|
* Date Author Notes
|
||||||
* 2009-01-05 Bernard first implementation
|
* 2009-01-05 Bernard first implementation
|
||||||
|
* 2018-08-17 whj add to new rt_console_set_device
|
||||||
*/
|
*/
|
||||||
|
|
||||||
#include <rthw.h>
|
#include <rthw.h>
|
||||||
|
|
@ -67,8 +68,14 @@ void rt_hw_board_init(void)
|
||||||
/* Configure the SysTick */
|
/* Configure the SysTick */
|
||||||
SysTick_Config( SystemCoreClock / RT_TICK_PER_SECOND );
|
SysTick_Config( SystemCoreClock / RT_TICK_PER_SECOND );
|
||||||
|
|
||||||
|
rt_components_board_init();
|
||||||
|
|
||||||
rt_hw_usart_init();
|
rt_hw_usart_init();
|
||||||
|
|
||||||
|
#ifdef RT_USING_CONSOLE
|
||||||
rt_console_set_device(RT_CONSOLE_DEVICE_NAME);
|
rt_console_set_device(RT_CONSOLE_DEVICE_NAME);
|
||||||
|
#endif
|
||||||
|
|
||||||
}
|
}
|
||||||
|
|
||||||
/*@}*/
|
/*@}*/
|
||||||
|
|
|
||||||
|
|
@ -0,0 +1,865 @@
|
||||||
|
/*
|
||||||
|
* File : gpio.c
|
||||||
|
* This file is part of RT-Thread RTOS
|
||||||
|
* COPYRIGHT (C) 2015, RT-Thread Development Team
|
||||||
|
*
|
||||||
|
* The license and distribution terms for this file may be
|
||||||
|
* found in the file LICENSE in this distribution or at
|
||||||
|
* http://www.rt-thread.org/license/LICENSE
|
||||||
|
*
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|
* Change Logs:
|
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|
* Date Author Notes
|
||||||
|
* 2015-03-24 Bright the first version
|
||||||
|
* 2016-05-23 Margguo@gmail.com Add 48 pins IC define
|
||||||
|
*/
|
||||||
|
|
||||||
|
#include <rthw.h>
|
||||||
|
#include <rtdevice.h>
|
||||||
|
#include <board.h>
|
||||||
|
|
||||||
|
#ifdef RT_USING_PIN
|
||||||
|
|
||||||
|
#define STM32F10X_PIN_NUMBERS 100 //[48, 64, 100, 144 ]
|
||||||
|
|
||||||
|
#define __STM32_PIN(index, rcc, gpio, gpio_index) { 0, RCC_##rcc##Periph_GPIO##gpio, GPIO##gpio, GPIO_Pin_##gpio_index, GPIO_PortSourceGPIO##gpio, GPIO_PinSource##gpio_index}
|
||||||
|
#define __STM32_PIN_DEFAULT {-1, 0, 0, 0, 0, 0}
|
||||||
|
|
||||||
|
/* STM32 GPIO driver */
|
||||||
|
struct pin_index
|
||||||
|
{
|
||||||
|
int index;
|
||||||
|
uint32_t rcc;
|
||||||
|
GPIO_TypeDef *gpio;
|
||||||
|
uint32_t pin;
|
||||||
|
uint8_t port_source;
|
||||||
|
uint8_t pin_source;
|
||||||
|
};
|
||||||
|
|
||||||
|
static const struct pin_index pins[] =
|
||||||
|
{
|
||||||
|
#if (STM32F10X_PIN_NUMBERS == 48)
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(2, APB2, C, 13),
|
||||||
|
__STM32_PIN(3, APB2, C, 14),
|
||||||
|
__STM32_PIN(4, APB2, C, 15),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(10, APB2, A, 0),
|
||||||
|
__STM32_PIN(11, APB2, A, 1),
|
||||||
|
__STM32_PIN(12, APB2, A, 2),
|
||||||
|
__STM32_PIN(13, APB2, A, 3),
|
||||||
|
__STM32_PIN(14, APB2, A, 4),
|
||||||
|
__STM32_PIN(15, APB2, A, 5),
|
||||||
|
__STM32_PIN(16, APB2, A, 6),
|
||||||
|
__STM32_PIN(17, APB2, A, 7),
|
||||||
|
__STM32_PIN(18, APB2, B, 0),
|
||||||
|
__STM32_PIN(19, APB2, B, 1),
|
||||||
|
__STM32_PIN(20, APB2, B, 2),
|
||||||
|
__STM32_PIN(21, APB2, B, 10),
|
||||||
|
__STM32_PIN(22, APB2, B, 11),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(25, APB2, B, 12),
|
||||||
|
__STM32_PIN(26, APB2, B, 13),
|
||||||
|
__STM32_PIN(27, APB2, B, 14),
|
||||||
|
__STM32_PIN(28, APB2, B, 15),
|
||||||
|
__STM32_PIN(29, APB2, A, 8),
|
||||||
|
__STM32_PIN(30, APB2, A, 9),
|
||||||
|
__STM32_PIN(31, APB2, A, 10),
|
||||||
|
__STM32_PIN(32, APB2, A, 11),
|
||||||
|
__STM32_PIN(33, APB2, A, 12),
|
||||||
|
__STM32_PIN(34, APB2, A, 13),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(37, APB2, A, 14),
|
||||||
|
__STM32_PIN(38, APB2, A, 15),
|
||||||
|
__STM32_PIN(39, APB2, B, 3),
|
||||||
|
__STM32_PIN(40, APB2, B, 4),
|
||||||
|
__STM32_PIN(41, APB2, B, 5),
|
||||||
|
__STM32_PIN(42, APB2, B, 6),
|
||||||
|
__STM32_PIN(43, APB2, B, 7),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(45, APB2, B, 8),
|
||||||
|
__STM32_PIN(46, APB2, B, 9),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
|
||||||
|
#endif
|
||||||
|
#if (STM32F10X_PIN_NUMBERS == 64)
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(2, APB2, C, 13),
|
||||||
|
__STM32_PIN(3, APB2, C, 14),
|
||||||
|
__STM32_PIN(4, APB2, C, 15),
|
||||||
|
__STM32_PIN(5, APB2, D, 0),
|
||||||
|
__STM32_PIN(6, APB2, D, 1),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(8, APB2, C, 0),
|
||||||
|
__STM32_PIN(9, APB2, C, 1),
|
||||||
|
__STM32_PIN(10, APB2, C, 2),
|
||||||
|
__STM32_PIN(11, APB2, C, 3),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(14, APB2, A, 0),
|
||||||
|
__STM32_PIN(15, APB2, A, 1),
|
||||||
|
__STM32_PIN(16, APB2, A, 2),
|
||||||
|
__STM32_PIN(17, APB2, A, 3),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(20, APB2, A, 4),
|
||||||
|
__STM32_PIN(21, APB2, A, 5),
|
||||||
|
__STM32_PIN(22, APB2, A, 6),
|
||||||
|
__STM32_PIN(23, APB2, A, 7),
|
||||||
|
__STM32_PIN(24, APB2, C, 4),
|
||||||
|
__STM32_PIN(25, APB2, C, 5),
|
||||||
|
__STM32_PIN(26, APB2, B, 0),
|
||||||
|
__STM32_PIN(27, APB2, B, 1),
|
||||||
|
__STM32_PIN(28, APB2, B, 2),
|
||||||
|
__STM32_PIN(29, APB2, B, 10),
|
||||||
|
__STM32_PIN(30, APB2, B, 11),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(33, APB2, B, 12),
|
||||||
|
__STM32_PIN(34, APB2, B, 13),
|
||||||
|
__STM32_PIN(35, APB2, B, 14),
|
||||||
|
__STM32_PIN(36, APB2, B, 15),
|
||||||
|
__STM32_PIN(37, APB2, C, 6),
|
||||||
|
__STM32_PIN(38, APB2, C, 7),
|
||||||
|
__STM32_PIN(39, APB2, C, 8),
|
||||||
|
__STM32_PIN(40, APB2, C, 9),
|
||||||
|
__STM32_PIN(41, APB2, A, 8),
|
||||||
|
__STM32_PIN(42, APB2, A, 9),
|
||||||
|
__STM32_PIN(43, APB2, A, 10),
|
||||||
|
__STM32_PIN(44, APB2, A, 11),
|
||||||
|
__STM32_PIN(45, APB2, A, 12),
|
||||||
|
__STM32_PIN(46, APB2, A, 13),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(49, APB2, A, 14),
|
||||||
|
__STM32_PIN(50, APB2, A, 15),
|
||||||
|
__STM32_PIN(51, APB2, C, 10),
|
||||||
|
__STM32_PIN(52, APB2, C, 11),
|
||||||
|
__STM32_PIN(53, APB2, C, 12),
|
||||||
|
__STM32_PIN(54, APB2, D, 2),
|
||||||
|
__STM32_PIN(55, APB2, B, 3),
|
||||||
|
__STM32_PIN(56, APB2, B, 4),
|
||||||
|
__STM32_PIN(57, APB2, B, 5),
|
||||||
|
__STM32_PIN(58, APB2, B, 6),
|
||||||
|
__STM32_PIN(59, APB2, B, 7),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(61, APB2, B, 8),
|
||||||
|
__STM32_PIN(62, APB2, B, 9),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
#endif
|
||||||
|
#if (STM32F10X_PIN_NUMBERS == 100)
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(1, APB2, E, 2),
|
||||||
|
__STM32_PIN(2, APB2, E, 3),
|
||||||
|
__STM32_PIN(3, APB2, E, 4),
|
||||||
|
__STM32_PIN(4, APB2, E, 5),
|
||||||
|
__STM32_PIN(5, APB2, E, 6),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(7, APB2, C, 13),
|
||||||
|
__STM32_PIN(8, APB2, C, 14),
|
||||||
|
__STM32_PIN(9, APB2, C, 15),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(15, APB2, C, 0),
|
||||||
|
__STM32_PIN(16, APB2, C, 1),
|
||||||
|
__STM32_PIN(17, APB2, C, 2),
|
||||||
|
__STM32_PIN(18, APB2, C, 3),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(23, APB2, A, 0),
|
||||||
|
__STM32_PIN(24, APB2, A, 1),
|
||||||
|
__STM32_PIN(25, APB2, A, 2),
|
||||||
|
__STM32_PIN(26, APB2, A, 3),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(29, APB2, A, 4),
|
||||||
|
__STM32_PIN(30, APB2, A, 5),
|
||||||
|
__STM32_PIN(31, APB2, A, 6),
|
||||||
|
__STM32_PIN(32, APB2, A, 7),
|
||||||
|
__STM32_PIN(33, APB2, C, 4),
|
||||||
|
__STM32_PIN(34, APB2, C, 5),
|
||||||
|
__STM32_PIN(35, APB2, B, 0),
|
||||||
|
__STM32_PIN(36, APB2, B, 1),
|
||||||
|
__STM32_PIN(37, APB2, B, 2),
|
||||||
|
__STM32_PIN(38, APB2, E, 7),
|
||||||
|
__STM32_PIN(39, APB2, E, 8),
|
||||||
|
__STM32_PIN(40, APB2, E, 9),
|
||||||
|
__STM32_PIN(41, APB2, E, 10),
|
||||||
|
__STM32_PIN(42, APB2, E, 11),
|
||||||
|
__STM32_PIN(43, APB2, E, 12),
|
||||||
|
__STM32_PIN(44, APB2, E, 13),
|
||||||
|
__STM32_PIN(45, APB2, E, 14),
|
||||||
|
__STM32_PIN(46, APB2, E, 15),
|
||||||
|
__STM32_PIN(47, APB2, B, 10),
|
||||||
|
__STM32_PIN(48, APB2, B, 11),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(51, APB2, B, 12),
|
||||||
|
__STM32_PIN(52, APB2, B, 13),
|
||||||
|
__STM32_PIN(53, APB2, B, 14),
|
||||||
|
__STM32_PIN(54, APB2, B, 15),
|
||||||
|
__STM32_PIN(55, APB2, D, 8),
|
||||||
|
__STM32_PIN(56, APB2, D, 9),
|
||||||
|
__STM32_PIN(57, APB2, D, 10),
|
||||||
|
__STM32_PIN(58, APB2, D, 11),
|
||||||
|
__STM32_PIN(59, APB2, D, 12),
|
||||||
|
__STM32_PIN(60, APB2, D, 13),
|
||||||
|
__STM32_PIN(61, APB2, D, 14),
|
||||||
|
__STM32_PIN(62, APB2, D, 15),
|
||||||
|
__STM32_PIN(63, APB2, C, 6),
|
||||||
|
__STM32_PIN(64, APB2, C, 7),
|
||||||
|
__STM32_PIN(65, APB2, C, 8),
|
||||||
|
__STM32_PIN(66, APB2, C, 9),
|
||||||
|
__STM32_PIN(67, APB2, A, 8),
|
||||||
|
__STM32_PIN(68, APB2, A, 9),
|
||||||
|
__STM32_PIN(69, APB2, A, 10),
|
||||||
|
__STM32_PIN(70, APB2, A, 11),
|
||||||
|
__STM32_PIN(71, APB2, A, 12),
|
||||||
|
__STM32_PIN(72, APB2, A, 13),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(76, APB2, A, 14),
|
||||||
|
__STM32_PIN(77, APB2, A, 15),
|
||||||
|
__STM32_PIN(78, APB2, C, 10),
|
||||||
|
__STM32_PIN(79, APB2, C, 11),
|
||||||
|
__STM32_PIN(80, APB2, C, 12),
|
||||||
|
__STM32_PIN(81, APB2, D, 0),
|
||||||
|
__STM32_PIN(82, APB2, D, 1),
|
||||||
|
__STM32_PIN(83, APB2, D, 2),
|
||||||
|
__STM32_PIN(84, APB2, D, 3),
|
||||||
|
__STM32_PIN(85, APB2, D, 4),
|
||||||
|
__STM32_PIN(86, APB2, D, 5),
|
||||||
|
__STM32_PIN(87, APB2, D, 6),
|
||||||
|
__STM32_PIN(88, APB2, D, 7),
|
||||||
|
__STM32_PIN(89, APB2, B, 3),
|
||||||
|
__STM32_PIN(90, APB2, B, 4),
|
||||||
|
__STM32_PIN(91, APB2, B, 5),
|
||||||
|
__STM32_PIN(92, APB2, B, 6),
|
||||||
|
__STM32_PIN(93, APB2, B, 7),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(95, APB2, B, 8),
|
||||||
|
__STM32_PIN(96, APB2, B, 9),
|
||||||
|
__STM32_PIN(97, APB2, E, 0),
|
||||||
|
__STM32_PIN(98, APB2, E, 1),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
#endif
|
||||||
|
#if (STM32F10X_PIN_NUMBERS == 144)
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(1, APB2, E, 2),
|
||||||
|
__STM32_PIN(2, APB2, E, 3),
|
||||||
|
__STM32_PIN(3, APB2, E, 4),
|
||||||
|
__STM32_PIN(4, APB2, E, 5),
|
||||||
|
__STM32_PIN(5, APB2, E, 6),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(7, APB2, C, 13),
|
||||||
|
__STM32_PIN(8, APB2, C, 14),
|
||||||
|
__STM32_PIN(9, APB2, C, 15),
|
||||||
|
|
||||||
|
__STM32_PIN(10, APB2, F, 0),
|
||||||
|
__STM32_PIN(11, APB2, F, 1),
|
||||||
|
__STM32_PIN(12, APB2, F, 2),
|
||||||
|
__STM32_PIN(13, APB2, F, 3),
|
||||||
|
__STM32_PIN(14, APB2, F, 4),
|
||||||
|
__STM32_PIN(15, APB2, F, 5),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(18, APB2, F, 6),
|
||||||
|
__STM32_PIN(19, APB2, F, 7),
|
||||||
|
__STM32_PIN(20, APB2, F, 8),
|
||||||
|
__STM32_PIN(21, APB2, F, 9),
|
||||||
|
__STM32_PIN(22, APB2, F, 10),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(26, APB2, C, 0),
|
||||||
|
__STM32_PIN(27, APB2, C, 1),
|
||||||
|
__STM32_PIN(28, APB2, C, 2),
|
||||||
|
__STM32_PIN(29, APB2, C, 3),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(34, APB2, A, 0),
|
||||||
|
__STM32_PIN(35, APB2, A, 1),
|
||||||
|
__STM32_PIN(36, APB2, A, 2),
|
||||||
|
__STM32_PIN(37, APB2, A, 3),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(40, APB2, A, 4),
|
||||||
|
__STM32_PIN(41, APB2, A, 5),
|
||||||
|
__STM32_PIN(42, APB2, A, 6),
|
||||||
|
__STM32_PIN(43, APB2, A, 7),
|
||||||
|
__STM32_PIN(44, APB2, C, 4),
|
||||||
|
__STM32_PIN(45, APB2, C, 5),
|
||||||
|
__STM32_PIN(46, APB2, B, 0),
|
||||||
|
__STM32_PIN(47, APB2, B, 1),
|
||||||
|
__STM32_PIN(48, APB2, B, 2),
|
||||||
|
__STM32_PIN(49, APB2, F, 11),
|
||||||
|
__STM32_PIN(50, APB2, F, 12),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(53, APB2, F, 13),
|
||||||
|
__STM32_PIN(54, APB2, F, 14),
|
||||||
|
__STM32_PIN(55, APB2, F, 15),
|
||||||
|
__STM32_PIN(56, APB2, G, 0),
|
||||||
|
__STM32_PIN(57, APB2, G, 1),
|
||||||
|
__STM32_PIN(58, APB2, E, 7),
|
||||||
|
__STM32_PIN(59, APB2, E, 8),
|
||||||
|
__STM32_PIN(60, APB2, E, 9),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(63, APB2, E, 10),
|
||||||
|
__STM32_PIN(64, APB2, E, 11),
|
||||||
|
__STM32_PIN(65, APB2, E, 12),
|
||||||
|
__STM32_PIN(66, APB2, E, 13),
|
||||||
|
__STM32_PIN(67, APB2, E, 14),
|
||||||
|
__STM32_PIN(68, APB2, E, 15),
|
||||||
|
__STM32_PIN(69, APB2, B, 10),
|
||||||
|
__STM32_PIN(70, APB2, B, 11),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(73, APB2, B, 12),
|
||||||
|
__STM32_PIN(74, APB2, B, 13),
|
||||||
|
__STM32_PIN(75, APB2, B, 14),
|
||||||
|
__STM32_PIN(76, APB2, B, 15),
|
||||||
|
__STM32_PIN(77, APB2, D, 8),
|
||||||
|
__STM32_PIN(78, APB2, D, 9),
|
||||||
|
__STM32_PIN(79, APB2, D, 10),
|
||||||
|
__STM32_PIN(80, APB2, D, 11),
|
||||||
|
__STM32_PIN(81, APB2, D, 12),
|
||||||
|
__STM32_PIN(82, APB2, D, 13),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(85, APB2, D, 14),
|
||||||
|
__STM32_PIN(86, APB2, D, 15),
|
||||||
|
__STM32_PIN(87, APB2, G, 2),
|
||||||
|
__STM32_PIN(88, APB2, G, 3),
|
||||||
|
__STM32_PIN(89, APB2, G, 4),
|
||||||
|
__STM32_PIN(90, APB2, G, 5),
|
||||||
|
__STM32_PIN(91, APB2, G, 6),
|
||||||
|
__STM32_PIN(92, APB2, G, 7),
|
||||||
|
__STM32_PIN(93, APB2, G, 8),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(96, APB2, C, 6),
|
||||||
|
__STM32_PIN(97, APB2, C, 7),
|
||||||
|
__STM32_PIN(98, APB2, C, 8),
|
||||||
|
__STM32_PIN(99, APB2, C, 9),
|
||||||
|
__STM32_PIN(100, APB2, A, 8),
|
||||||
|
__STM32_PIN(101, APB2, A, 9),
|
||||||
|
__STM32_PIN(102, APB2, A, 10),
|
||||||
|
__STM32_PIN(103, APB2, A, 11),
|
||||||
|
__STM32_PIN(104, APB2, A, 12),
|
||||||
|
__STM32_PIN(105, APB2, A, 13),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(109, APB2, A, 14),
|
||||||
|
__STM32_PIN(110, APB2, A, 15),
|
||||||
|
__STM32_PIN(111, APB2, C, 10),
|
||||||
|
__STM32_PIN(112, APB2, C, 11),
|
||||||
|
__STM32_PIN(113, APB2, C, 12),
|
||||||
|
__STM32_PIN(114, APB2, D, 0),
|
||||||
|
__STM32_PIN(115, APB2, D, 1),
|
||||||
|
__STM32_PIN(116, APB2, D, 2),
|
||||||
|
__STM32_PIN(117, APB2, D, 3),
|
||||||
|
__STM32_PIN(118, APB2, D, 4),
|
||||||
|
__STM32_PIN(119, APB2, D, 5),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(122, APB2, D, 6),
|
||||||
|
__STM32_PIN(123, APB2, D, 7),
|
||||||
|
__STM32_PIN(124, APB2, G, 9),
|
||||||
|
__STM32_PIN(125, APB2, G, 10),
|
||||||
|
__STM32_PIN(126, APB2, G, 11),
|
||||||
|
__STM32_PIN(127, APB2, G, 12),
|
||||||
|
__STM32_PIN(128, APB2, G, 13),
|
||||||
|
__STM32_PIN(129, APB2, G, 14),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(132, APB2, G, 15),
|
||||||
|
__STM32_PIN(133, APB2, B, 3),
|
||||||
|
__STM32_PIN(134, APB2, B, 4),
|
||||||
|
__STM32_PIN(135, APB2, B, 5),
|
||||||
|
__STM32_PIN(136, APB2, B, 6),
|
||||||
|
__STM32_PIN(137, APB2, B, 7),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN(139, APB2, B, 8),
|
||||||
|
__STM32_PIN(140, APB2, B, 9),
|
||||||
|
__STM32_PIN(141, APB2, E, 0),
|
||||||
|
__STM32_PIN(142, APB2, E, 1),
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
__STM32_PIN_DEFAULT,
|
||||||
|
#endif
|
||||||
|
};
|
||||||
|
|
||||||
|
struct pin_irq_map
|
||||||
|
{
|
||||||
|
rt_uint16_t pinbit;
|
||||||
|
rt_uint32_t irqbit;
|
||||||
|
enum IRQn irqno;
|
||||||
|
};
|
||||||
|
static const struct pin_irq_map pin_irq_map[] =
|
||||||
|
{
|
||||||
|
{GPIO_Pin_0, EXTI_Line0, EXTI0_IRQn },
|
||||||
|
{GPIO_Pin_1, EXTI_Line1, EXTI1_IRQn },
|
||||||
|
{GPIO_Pin_2, EXTI_Line2, EXTI2_IRQn },
|
||||||
|
{GPIO_Pin_3, EXTI_Line3, EXTI3_IRQn },
|
||||||
|
{GPIO_Pin_4, EXTI_Line4, EXTI4_IRQn },
|
||||||
|
{GPIO_Pin_5, EXTI_Line5, EXTI9_5_IRQn },
|
||||||
|
{GPIO_Pin_6, EXTI_Line6, EXTI9_5_IRQn },
|
||||||
|
{GPIO_Pin_7, EXTI_Line7, EXTI9_5_IRQn },
|
||||||
|
{GPIO_Pin_8, EXTI_Line8, EXTI9_5_IRQn },
|
||||||
|
{GPIO_Pin_9, EXTI_Line9, EXTI9_5_IRQn },
|
||||||
|
{GPIO_Pin_10, EXTI_Line10, EXTI15_10_IRQn},
|
||||||
|
{GPIO_Pin_11, EXTI_Line11, EXTI15_10_IRQn},
|
||||||
|
{GPIO_Pin_12, EXTI_Line12, EXTI15_10_IRQn},
|
||||||
|
{GPIO_Pin_13, EXTI_Line13, EXTI15_10_IRQn},
|
||||||
|
{GPIO_Pin_14, EXTI_Line14, EXTI15_10_IRQn},
|
||||||
|
{GPIO_Pin_15, EXTI_Line15, EXTI15_10_IRQn},
|
||||||
|
};
|
||||||
|
struct rt_pin_irq_hdr pin_irq_hdr_tab[] =
|
||||||
|
{
|
||||||
|
{-1, 0, RT_NULL, RT_NULL},
|
||||||
|
{-1, 0, RT_NULL, RT_NULL},
|
||||||
|
{-1, 0, RT_NULL, RT_NULL},
|
||||||
|
{-1, 0, RT_NULL, RT_NULL},
|
||||||
|
{-1, 0, RT_NULL, RT_NULL},
|
||||||
|
{-1, 0, RT_NULL, RT_NULL},
|
||||||
|
{-1, 0, RT_NULL, RT_NULL},
|
||||||
|
{-1, 0, RT_NULL, RT_NULL},
|
||||||
|
{-1, 0, RT_NULL, RT_NULL},
|
||||||
|
{-1, 0, RT_NULL, RT_NULL},
|
||||||
|
{-1, 0, RT_NULL, RT_NULL},
|
||||||
|
{-1, 0, RT_NULL, RT_NULL},
|
||||||
|
{-1, 0, RT_NULL, RT_NULL},
|
||||||
|
{-1, 0, RT_NULL, RT_NULL},
|
||||||
|
{-1, 0, RT_NULL, RT_NULL},
|
||||||
|
{-1, 0, RT_NULL, RT_NULL},
|
||||||
|
};
|
||||||
|
|
||||||
|
#define ITEM_NUM(items) sizeof(items)/sizeof(items[0])
|
||||||
|
const struct pin_index *get_pin(uint8_t pin)
|
||||||
|
{
|
||||||
|
const struct pin_index *index;
|
||||||
|
|
||||||
|
if (pin < ITEM_NUM(pins))
|
||||||
|
{
|
||||||
|
index = &pins[pin];
|
||||||
|
if (index->index == -1)
|
||||||
|
index = RT_NULL;
|
||||||
|
}
|
||||||
|
else
|
||||||
|
{
|
||||||
|
index = RT_NULL;
|
||||||
|
}
|
||||||
|
|
||||||
|
return index;
|
||||||
|
};
|
||||||
|
|
||||||
|
void stm32_pin_write(rt_device_t dev, rt_base_t pin, rt_base_t value)
|
||||||
|
{
|
||||||
|
const struct pin_index *index;
|
||||||
|
|
||||||
|
index = get_pin(pin);
|
||||||
|
if (index == RT_NULL)
|
||||||
|
{
|
||||||
|
return;
|
||||||
|
}
|
||||||
|
|
||||||
|
if (value == PIN_LOW)
|
||||||
|
{
|
||||||
|
GPIO_ResetBits(index->gpio, index->pin);
|
||||||
|
}
|
||||||
|
else
|
||||||
|
{
|
||||||
|
GPIO_SetBits(index->gpio, index->pin);
|
||||||
|
}
|
||||||
|
}
|
||||||
|
|
||||||
|
int stm32_pin_read(rt_device_t dev, rt_base_t pin)
|
||||||
|
{
|
||||||
|
int value;
|
||||||
|
const struct pin_index *index;
|
||||||
|
|
||||||
|
value = PIN_LOW;
|
||||||
|
|
||||||
|
index = get_pin(pin);
|
||||||
|
if (index == RT_NULL)
|
||||||
|
{
|
||||||
|
return value;
|
||||||
|
}
|
||||||
|
|
||||||
|
if (GPIO_ReadInputDataBit(index->gpio, index->pin) == Bit_RESET)
|
||||||
|
{
|
||||||
|
value = PIN_LOW;
|
||||||
|
}
|
||||||
|
else
|
||||||
|
{
|
||||||
|
value = PIN_HIGH;
|
||||||
|
}
|
||||||
|
|
||||||
|
return value;
|
||||||
|
}
|
||||||
|
|
||||||
|
void stm32_pin_mode(rt_device_t dev, rt_base_t pin, rt_base_t mode)
|
||||||
|
{
|
||||||
|
const struct pin_index *index;
|
||||||
|
GPIO_InitTypeDef GPIO_InitStructure;
|
||||||
|
|
||||||
|
index = get_pin(pin);
|
||||||
|
if (index == RT_NULL)
|
||||||
|
{
|
||||||
|
return;
|
||||||
|
}
|
||||||
|
|
||||||
|
/* GPIO Periph clock enable */
|
||||||
|
RCC_APB2PeriphClockCmd(index->rcc, ENABLE);
|
||||||
|
|
||||||
|
/* Configure GPIO_InitStructure */
|
||||||
|
GPIO_InitStructure.GPIO_Pin = index->pin;
|
||||||
|
GPIO_InitStructure.GPIO_Mode = GPIO_Mode_Out_PP;
|
||||||
|
GPIO_InitStructure.GPIO_Speed = GPIO_Speed_50MHz;
|
||||||
|
|
||||||
|
if (mode == PIN_MODE_OUTPUT)
|
||||||
|
{
|
||||||
|
/* output setting */
|
||||||
|
GPIO_InitStructure.GPIO_Mode = GPIO_Mode_Out_PP;
|
||||||
|
}
|
||||||
|
else if (mode == PIN_MODE_INPUT)
|
||||||
|
{
|
||||||
|
/* input setting: not pull. */
|
||||||
|
GPIO_InitStructure.GPIO_Mode = GPIO_Mode_IN_FLOATING;
|
||||||
|
}
|
||||||
|
else if (mode == PIN_MODE_INPUT_PULLUP)
|
||||||
|
{
|
||||||
|
/* input setting: pull up. */
|
||||||
|
GPIO_InitStructure.GPIO_Mode = GPIO_Mode_IPU;
|
||||||
|
}
|
||||||
|
else
|
||||||
|
{
|
||||||
|
/* input setting:default. */
|
||||||
|
GPIO_InitStructure.GPIO_Mode = GPIO_Mode_IPD;
|
||||||
|
}
|
||||||
|
GPIO_Init(index->gpio, &GPIO_InitStructure);
|
||||||
|
}
|
||||||
|
|
||||||
|
rt_inline rt_int32_t bit2bitno(rt_uint32_t bit)
|
||||||
|
{
|
||||||
|
int i;
|
||||||
|
for(i = 0; i < 32; i++)
|
||||||
|
{
|
||||||
|
if((0x01 << i) == bit)
|
||||||
|
{
|
||||||
|
return i;
|
||||||
|
}
|
||||||
|
}
|
||||||
|
return -1;
|
||||||
|
}
|
||||||
|
rt_inline const struct pin_irq_map *get_pin_irq_map(uint32_t pinbit)
|
||||||
|
{
|
||||||
|
rt_int32_t mapindex = bit2bitno(pinbit);
|
||||||
|
if(mapindex < 0 || mapindex >= ITEM_NUM(pin_irq_map))
|
||||||
|
{
|
||||||
|
return RT_NULL;
|
||||||
|
}
|
||||||
|
return &pin_irq_map[mapindex];
|
||||||
|
};
|
||||||
|
rt_err_t stm32_pin_attach_irq(struct rt_device *device, rt_int32_t pin,
|
||||||
|
rt_uint32_t mode, void (*hdr)(void *args), void *args)
|
||||||
|
{
|
||||||
|
const struct pin_index *index;
|
||||||
|
rt_base_t level;
|
||||||
|
rt_int32_t irqindex = -1;
|
||||||
|
|
||||||
|
index = get_pin(pin);
|
||||||
|
if (index == RT_NULL)
|
||||||
|
{
|
||||||
|
return -RT_ENOSYS;
|
||||||
|
}
|
||||||
|
irqindex = bit2bitno(index->pin);
|
||||||
|
if(irqindex < 0 || irqindex >= ITEM_NUM(pin_irq_map))
|
||||||
|
{
|
||||||
|
return -RT_ENOSYS;
|
||||||
|
}
|
||||||
|
|
||||||
|
level = rt_hw_interrupt_disable();
|
||||||
|
if(pin_irq_hdr_tab[irqindex].pin == pin &&
|
||||||
|
pin_irq_hdr_tab[irqindex].hdr == hdr &&
|
||||||
|
pin_irq_hdr_tab[irqindex].mode == mode &&
|
||||||
|
pin_irq_hdr_tab[irqindex].args == args
|
||||||
|
)
|
||||||
|
{
|
||||||
|
rt_hw_interrupt_enable(level);
|
||||||
|
return RT_EOK;
|
||||||
|
}
|
||||||
|
if(pin_irq_hdr_tab[irqindex].pin != -1)
|
||||||
|
{
|
||||||
|
rt_hw_interrupt_enable(level);
|
||||||
|
return -RT_EBUSY;
|
||||||
|
}
|
||||||
|
pin_irq_hdr_tab[irqindex].pin = pin;
|
||||||
|
pin_irq_hdr_tab[irqindex].hdr = hdr;
|
||||||
|
pin_irq_hdr_tab[irqindex].mode = mode;
|
||||||
|
pin_irq_hdr_tab[irqindex].args = args;
|
||||||
|
rt_hw_interrupt_enable(level);
|
||||||
|
|
||||||
|
return RT_EOK;
|
||||||
|
}
|
||||||
|
rt_err_t stm32_pin_detach_irq(struct rt_device *device, rt_int32_t pin)
|
||||||
|
{
|
||||||
|
const struct pin_index *index;
|
||||||
|
rt_base_t level;
|
||||||
|
rt_int32_t irqindex = -1;
|
||||||
|
|
||||||
|
index = get_pin(pin);
|
||||||
|
if (index == RT_NULL)
|
||||||
|
{
|
||||||
|
return -RT_ENOSYS;
|
||||||
|
}
|
||||||
|
irqindex = bit2bitno(index->pin);
|
||||||
|
if(irqindex < 0 || irqindex >= ITEM_NUM(pin_irq_map))
|
||||||
|
{
|
||||||
|
return -RT_ENOSYS;
|
||||||
|
}
|
||||||
|
|
||||||
|
level = rt_hw_interrupt_disable();
|
||||||
|
if(pin_irq_hdr_tab[irqindex].pin == -1)
|
||||||
|
{
|
||||||
|
rt_hw_interrupt_enable(level);
|
||||||
|
return RT_EOK;
|
||||||
|
}
|
||||||
|
pin_irq_hdr_tab[irqindex].pin = -1;
|
||||||
|
pin_irq_hdr_tab[irqindex].hdr = RT_NULL;
|
||||||
|
pin_irq_hdr_tab[irqindex].mode = 0;
|
||||||
|
pin_irq_hdr_tab[irqindex].args = RT_NULL;
|
||||||
|
rt_hw_interrupt_enable(level);
|
||||||
|
|
||||||
|
return RT_EOK;
|
||||||
|
}
|
||||||
|
rt_err_t stm32_pin_irq_enable(struct rt_device *device, rt_base_t pin,
|
||||||
|
rt_uint32_t enabled)
|
||||||
|
{
|
||||||
|
const struct pin_index *index;
|
||||||
|
const struct pin_irq_map *irqmap;
|
||||||
|
rt_base_t level;
|
||||||
|
rt_int32_t irqindex = -1;
|
||||||
|
GPIO_InitTypeDef GPIO_InitStructure;
|
||||||
|
NVIC_InitTypeDef NVIC_InitStructure;
|
||||||
|
EXTI_InitTypeDef EXTI_InitStructure;
|
||||||
|
|
||||||
|
index = get_pin(pin);
|
||||||
|
if (index == RT_NULL)
|
||||||
|
{
|
||||||
|
return -RT_ENOSYS;
|
||||||
|
}
|
||||||
|
if(enabled == PIN_IRQ_ENABLE)
|
||||||
|
{
|
||||||
|
irqindex = bit2bitno(index->pin);
|
||||||
|
if(irqindex < 0 || irqindex >= ITEM_NUM(pin_irq_map))
|
||||||
|
{
|
||||||
|
return -RT_ENOSYS;
|
||||||
|
}
|
||||||
|
level = rt_hw_interrupt_disable();
|
||||||
|
if(pin_irq_hdr_tab[irqindex].pin == -1)
|
||||||
|
{
|
||||||
|
rt_hw_interrupt_enable(level);
|
||||||
|
return -RT_ENOSYS;
|
||||||
|
}
|
||||||
|
irqmap = &pin_irq_map[irqindex];
|
||||||
|
/* GPIO Periph clock enable */
|
||||||
|
RCC_APB2PeriphClockCmd(index->rcc, ENABLE);
|
||||||
|
/* Configure GPIO_InitStructure */
|
||||||
|
GPIO_InitStructure.GPIO_Pin = index->pin;
|
||||||
|
GPIO_InitStructure.GPIO_Mode = GPIO_Mode_IPU;
|
||||||
|
GPIO_InitStructure.GPIO_Speed = GPIO_Speed_50MHz;
|
||||||
|
GPIO_Init(index->gpio, &GPIO_InitStructure);
|
||||||
|
|
||||||
|
NVIC_InitStructure.NVIC_IRQChannel= irqmap->irqno;
|
||||||
|
NVIC_InitStructure.NVIC_IRQChannelPreemptionPriority= 2;
|
||||||
|
NVIC_InitStructure.NVIC_IRQChannelSubPriority= 2;
|
||||||
|
NVIC_InitStructure.NVIC_IRQChannelCmd=ENABLE;
|
||||||
|
NVIC_Init(&NVIC_InitStructure);
|
||||||
|
|
||||||
|
GPIO_EXTILineConfig(index->port_source, index->pin_source);
|
||||||
|
EXTI_InitStructure.EXTI_Line = irqmap->irqbit;
|
||||||
|
EXTI_InitStructure.EXTI_Mode = EXTI_Mode_Interrupt;
|
||||||
|
switch(pin_irq_hdr_tab[irqindex].mode)
|
||||||
|
{
|
||||||
|
case PIN_IRQ_MODE_RISING:
|
||||||
|
EXTI_InitStructure.EXTI_Trigger = EXTI_Trigger_Rising;
|
||||||
|
break;
|
||||||
|
case PIN_IRQ_MODE_FALLING:
|
||||||
|
EXTI_InitStructure.EXTI_Trigger = EXTI_Trigger_Falling;
|
||||||
|
break;
|
||||||
|
case PIN_IRQ_MODE_RISING_FALLING:
|
||||||
|
EXTI_InitStructure.EXTI_Trigger = EXTI_Trigger_Rising_Falling;
|
||||||
|
break;
|
||||||
|
}
|
||||||
|
EXTI_InitStructure.EXTI_LineCmd = ENABLE;
|
||||||
|
EXTI_Init(&EXTI_InitStructure);
|
||||||
|
rt_hw_interrupt_enable(level);
|
||||||
|
}
|
||||||
|
else if(enabled == PIN_IRQ_DISABLE)
|
||||||
|
{
|
||||||
|
irqmap = get_pin_irq_map(index->pin);
|
||||||
|
if(irqmap == RT_NULL)
|
||||||
|
{
|
||||||
|
return -RT_ENOSYS;
|
||||||
|
}
|
||||||
|
EXTI_InitStructure.EXTI_Line = irqmap->irqbit;
|
||||||
|
EXTI_InitStructure.EXTI_Mode = EXTI_Mode_Interrupt;
|
||||||
|
EXTI_InitStructure.EXTI_Trigger = EXTI_Trigger_Rising;
|
||||||
|
EXTI_InitStructure.EXTI_LineCmd = DISABLE;
|
||||||
|
EXTI_Init(&EXTI_InitStructure);
|
||||||
|
}
|
||||||
|
else
|
||||||
|
{
|
||||||
|
return -RT_ENOSYS;
|
||||||
|
}
|
||||||
|
|
||||||
|
return RT_EOK;
|
||||||
|
}
|
||||||
|
const static struct rt_pin_ops _stm32_pin_ops =
|
||||||
|
{
|
||||||
|
stm32_pin_mode,
|
||||||
|
stm32_pin_write,
|
||||||
|
stm32_pin_read,
|
||||||
|
stm32_pin_attach_irq,
|
||||||
|
stm32_pin_detach_irq,
|
||||||
|
stm32_pin_irq_enable,
|
||||||
|
};
|
||||||
|
|
||||||
|
int stm32_hw_pin_init(void)
|
||||||
|
{
|
||||||
|
int result;
|
||||||
|
|
||||||
|
result = rt_device_pin_register("pin", &_stm32_pin_ops, RT_NULL);
|
||||||
|
return result;
|
||||||
|
}
|
||||||
|
INIT_BOARD_EXPORT(stm32_hw_pin_init);
|
||||||
|
|
||||||
|
rt_inline void pin_irq_hdr(int irqno)
|
||||||
|
{
|
||||||
|
EXTI_ClearITPendingBit(pin_irq_map[irqno].irqbit);
|
||||||
|
if(pin_irq_hdr_tab[irqno].hdr)
|
||||||
|
{
|
||||||
|
pin_irq_hdr_tab[irqno].hdr(pin_irq_hdr_tab[irqno].args);
|
||||||
|
}
|
||||||
|
}
|
||||||
|
void EXTI0_IRQHandler(void)
|
||||||
|
{
|
||||||
|
/* enter interrupt */
|
||||||
|
rt_interrupt_enter();
|
||||||
|
pin_irq_hdr(0);
|
||||||
|
/* leave interrupt */
|
||||||
|
rt_interrupt_leave();
|
||||||
|
}
|
||||||
|
void EXTI1_IRQHandler(void)
|
||||||
|
{
|
||||||
|
/* enter interrupt */
|
||||||
|
rt_interrupt_enter();
|
||||||
|
pin_irq_hdr(1);
|
||||||
|
/* leave interrupt */
|
||||||
|
rt_interrupt_leave();
|
||||||
|
}
|
||||||
|
void EXTI2_IRQHandler(void)
|
||||||
|
{
|
||||||
|
/* enter interrupt */
|
||||||
|
rt_interrupt_enter();
|
||||||
|
pin_irq_hdr(2);
|
||||||
|
/* leave interrupt */
|
||||||
|
rt_interrupt_leave();
|
||||||
|
}
|
||||||
|
void EXTI3_IRQHandler(void)
|
||||||
|
{
|
||||||
|
/* enter interrupt */
|
||||||
|
rt_interrupt_enter();
|
||||||
|
pin_irq_hdr(3);
|
||||||
|
/* leave interrupt */
|
||||||
|
rt_interrupt_leave();
|
||||||
|
}
|
||||||
|
void EXTI4_IRQHandler(void)
|
||||||
|
{
|
||||||
|
/* enter interrupt */
|
||||||
|
rt_interrupt_enter();
|
||||||
|
pin_irq_hdr(4);
|
||||||
|
/* leave interrupt */
|
||||||
|
rt_interrupt_leave();
|
||||||
|
}
|
||||||
|
void EXTI9_5_IRQHandler(void)
|
||||||
|
{
|
||||||
|
/* enter interrupt */
|
||||||
|
rt_interrupt_enter();
|
||||||
|
if(EXTI_GetITStatus(EXTI_Line5) != RESET)
|
||||||
|
{
|
||||||
|
pin_irq_hdr(5);
|
||||||
|
}
|
||||||
|
if(EXTI_GetITStatus(EXTI_Line6) != RESET)
|
||||||
|
{
|
||||||
|
pin_irq_hdr(6);
|
||||||
|
}
|
||||||
|
if(EXTI_GetITStatus(EXTI_Line7) != RESET)
|
||||||
|
{
|
||||||
|
pin_irq_hdr(7);
|
||||||
|
}
|
||||||
|
if(EXTI_GetITStatus(EXTI_Line8) != RESET)
|
||||||
|
{
|
||||||
|
pin_irq_hdr(8);
|
||||||
|
}
|
||||||
|
if(EXTI_GetITStatus(EXTI_Line9) != RESET)
|
||||||
|
{
|
||||||
|
pin_irq_hdr(9);
|
||||||
|
}
|
||||||
|
/* leave interrupt */
|
||||||
|
rt_interrupt_leave();
|
||||||
|
}
|
||||||
|
void EXTI15_10_IRQHandler(void)
|
||||||
|
{
|
||||||
|
/* enter interrupt */
|
||||||
|
rt_interrupt_enter();
|
||||||
|
if(EXTI_GetITStatus(EXTI_Line10) != RESET)
|
||||||
|
{
|
||||||
|
pin_irq_hdr(10);
|
||||||
|
}
|
||||||
|
if(EXTI_GetITStatus(EXTI_Line11) != RESET)
|
||||||
|
{
|
||||||
|
pin_irq_hdr(11);
|
||||||
|
}
|
||||||
|
if(EXTI_GetITStatus(EXTI_Line12) != RESET)
|
||||||
|
{
|
||||||
|
pin_irq_hdr(12);
|
||||||
|
}
|
||||||
|
if(EXTI_GetITStatus(EXTI_Line13) != RESET)
|
||||||
|
{
|
||||||
|
pin_irq_hdr(13);
|
||||||
|
}
|
||||||
|
if(EXTI_GetITStatus(EXTI_Line14) != RESET)
|
||||||
|
{
|
||||||
|
pin_irq_hdr(14);
|
||||||
|
}
|
||||||
|
if(EXTI_GetITStatus(EXTI_Line15) != RESET)
|
||||||
|
{
|
||||||
|
pin_irq_hdr(15);
|
||||||
|
}
|
||||||
|
/* leave interrupt */
|
||||||
|
rt_interrupt_leave();
|
||||||
|
}
|
||||||
|
|
||||||
|
#endif
|
||||||
|
|
@ -0,0 +1,30 @@
|
||||||
|
/*
|
||||||
|
* File : gpio.h
|
||||||
|
* This file is part of RT-Thread RTOS
|
||||||
|
* COPYRIGHT (C) 2015, RT-Thread Development Team
|
||||||
|
*
|
||||||
|
* The license and distribution terms for this file may be
|
||||||
|
* found in the file LICENSE in this distribution or at
|
||||||
|
* http://www.rt-thread.org/license/LICENSE
|
||||||
|
*
|
||||||
|
* Change Logs:
|
||||||
|
* Date Author Notes
|
||||||
|
* 2015-01-05 Bernard the first version
|
||||||
|
*/
|
||||||
|
#ifndef GPIO_H__
|
||||||
|
#define GPIO_H__
|
||||||
|
|
||||||
|
|
||||||
|
struct stm32_hw_pin_userdata
|
||||||
|
{
|
||||||
|
int pin;
|
||||||
|
uint32_t mode;
|
||||||
|
};
|
||||||
|
|
||||||
|
#define PIN_USERDATA_END {-1,0}
|
||||||
|
|
||||||
|
extern struct stm32_hw_pin_userdata stm32_pins[];
|
||||||
|
|
||||||
|
int stm32_hw_pin_init(void);
|
||||||
|
|
||||||
|
#endif
|
||||||
|
|
@ -0,0 +1,163 @@
|
||||||
|
/*
|
||||||
|
* File : stm32f1_rtc.c
|
||||||
|
* This file is part of RT-Thread RTOS
|
||||||
|
* COPYRIGHT (C) 2009, RT-Thread Development Team
|
||||||
|
*
|
||||||
|
* The license and distribution terms for this file may be
|
||||||
|
* found in the file LICENSE in this distribution or at
|
||||||
|
* http://www.rt-thread.org/license/LICENSE
|
||||||
|
*
|
||||||
|
* Change Logs:
|
||||||
|
* Date Author Notes
|
||||||
|
* 2009-01-05 Bernard the first version.
|
||||||
|
* 2011-11-26 aozima implementation time.
|
||||||
|
* 2015-07-16 FlyM rename rtc to stm32f1_rtc. remove finsh export function
|
||||||
|
*/
|
||||||
|
|
||||||
|
#include <rtthread.h>
|
||||||
|
#include <stm32f10x.h>
|
||||||
|
#include "stm32f1_rtc.h"
|
||||||
|
|
||||||
|
static struct rt_device rtc;
|
||||||
|
static rt_err_t rt_rtc_open(rt_device_t dev, rt_uint16_t oflag)
|
||||||
|
{
|
||||||
|
if (dev->rx_indicate != RT_NULL)
|
||||||
|
{
|
||||||
|
/* Open Interrupt */
|
||||||
|
}
|
||||||
|
|
||||||
|
return RT_EOK;
|
||||||
|
}
|
||||||
|
|
||||||
|
static rt_size_t rt_rtc_read(rt_device_t dev, rt_off_t pos, void* buffer, rt_size_t size)
|
||||||
|
{
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
static rt_err_t rt_rtc_control(rt_device_t dev, int cmd, void *args)
|
||||||
|
{
|
||||||
|
rt_time_t *time;
|
||||||
|
RT_ASSERT(dev != RT_NULL);
|
||||||
|
|
||||||
|
switch (cmd)
|
||||||
|
{
|
||||||
|
case RT_DEVICE_CTRL_RTC_GET_TIME:
|
||||||
|
time = (rt_time_t *)args;
|
||||||
|
/* read device */
|
||||||
|
*time = RTC_GetCounter();
|
||||||
|
break;
|
||||||
|
|
||||||
|
case RT_DEVICE_CTRL_RTC_SET_TIME:
|
||||||
|
{
|
||||||
|
time = (rt_time_t *)args;
|
||||||
|
|
||||||
|
/* Enable PWR and BKP clocks */
|
||||||
|
RCC_APB1PeriphClockCmd(RCC_APB1Periph_PWR | RCC_APB1Periph_BKP, ENABLE);
|
||||||
|
|
||||||
|
/* Allow access to BKP Domain */
|
||||||
|
PWR_BackupAccessCmd(ENABLE);
|
||||||
|
|
||||||
|
/* Wait until last write operation on RTC registers has finished */
|
||||||
|
RTC_WaitForLastTask();
|
||||||
|
|
||||||
|
/* Change the current time */
|
||||||
|
RTC_SetCounter(*time);
|
||||||
|
|
||||||
|
/* Wait until last write operation on RTC registers has finished */
|
||||||
|
RTC_WaitForLastTask();
|
||||||
|
|
||||||
|
BKP_WriteBackupRegister(BKP_DR1, 0xA5A5);
|
||||||
|
}
|
||||||
|
break;
|
||||||
|
}
|
||||||
|
|
||||||
|
return RT_EOK;
|
||||||
|
}
|
||||||
|
|
||||||
|
/*******************************************************************************
|
||||||
|
* Function Name : RTC_Configuration
|
||||||
|
* Description : Configures the RTC.
|
||||||
|
* Input : None
|
||||||
|
* Output : None
|
||||||
|
* Return : 0 reday,-1 error.
|
||||||
|
*******************************************************************************/
|
||||||
|
int RTC_Configuration(void)
|
||||||
|
{
|
||||||
|
u32 count=0x200000;
|
||||||
|
|
||||||
|
/* Enable PWR and BKP clocks */
|
||||||
|
RCC_APB1PeriphClockCmd(RCC_APB1Periph_PWR | RCC_APB1Periph_BKP, ENABLE);
|
||||||
|
|
||||||
|
/* Allow access to BKP Domain */
|
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|
PWR_BackupAccessCmd(ENABLE);
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|
|
||||||
|
/* Reset Backup Domain */
|
||||||
|
BKP_DeInit();
|
||||||
|
|
||||||
|
/* Enable LSE */
|
||||||
|
RCC_LSEConfig(RCC_LSE_ON);
|
||||||
|
/* Wait till LSE is ready */
|
||||||
|
while ( (RCC_GetFlagStatus(RCC_FLAG_LSERDY) == RESET) && (--count) );
|
||||||
|
if ( count == 0 )
|
||||||
|
{
|
||||||
|
return -1;
|
||||||
|
}
|
||||||
|
|
||||||
|
/* Select LSE as RTC Clock Source */
|
||||||
|
RCC_RTCCLKConfig(RCC_RTCCLKSource_LSE);
|
||||||
|
|
||||||
|
/* Enable RTC Clock */
|
||||||
|
RCC_RTCCLKCmd(ENABLE);
|
||||||
|
|
||||||
|
/* Wait for RTC registers synchronization */
|
||||||
|
RTC_WaitForSynchro();
|
||||||
|
|
||||||
|
/* Wait until last write operation on RTC registers has finished */
|
||||||
|
RTC_WaitForLastTask();
|
||||||
|
|
||||||
|
/* Set RTC prescaler: set RTC period to 1sec */
|
||||||
|
RTC_SetPrescaler(32767); /* RTC period = RTCCLK/RTC_PR = (32.768 KHz)/(32767+1) */
|
||||||
|
|
||||||
|
/* Wait until last write operation on RTC registers has finished */
|
||||||
|
RTC_WaitForLastTask();
|
||||||
|
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
|
|
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|
void rt_hw_rtc_init(void)
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|
{
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|
rtc.type = RT_Device_Class_RTC;
|
||||||
|
|
||||||
|
if (BKP_ReadBackupRegister(BKP_DR1) != 0xA5A5)
|
||||||
|
{
|
||||||
|
rt_kprintf("rtc is not configured\n");
|
||||||
|
rt_kprintf("please configure with set_date and set_time\n");
|
||||||
|
if ( RTC_Configuration() != 0)
|
||||||
|
{
|
||||||
|
rt_kprintf("rtc configure fail...\r\n");
|
||||||
|
return ;
|
||||||
|
}
|
||||||
|
}
|
||||||
|
else
|
||||||
|
{
|
||||||
|
/* Wait for RTC registers synchronization */
|
||||||
|
RTC_WaitForSynchro();
|
||||||
|
}
|
||||||
|
|
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|
/* register rtc device */
|
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|
rtc.init = RT_NULL;
|
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|
rtc.open = rt_rtc_open;
|
||||||
|
rtc.close = RT_NULL;
|
||||||
|
rtc.read = rt_rtc_read;
|
||||||
|
rtc.write = RT_NULL;
|
||||||
|
rtc.control = rt_rtc_control;
|
||||||
|
|
||||||
|
/* no private */
|
||||||
|
rtc.user_data = RT_NULL;
|
||||||
|
|
||||||
|
rt_device_register(&rtc, "rtc", RT_DEVICE_FLAG_RDWR);
|
||||||
|
|
||||||
|
return;
|
||||||
|
}
|
||||||
|
|
||||||
|
|
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|
|
@ -0,0 +1,20 @@
|
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|
/*
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|
* File : stm32f1_rtc.h
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|
* This file is part of RT-Thread RTOS
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|
* COPYRIGHT (C) 2009, RT-Thread Development Team
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|
*
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|
* The license and distribution terms for this file may be
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||||||
|
* found in the file LICENSE in this distribution or at
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|
* http://www.rt-thread.org/license/LICENSE
|
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*
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|
* Change Logs:
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* Date Author Notes
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|
* 2009-01-05 Bernard the first version
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|
*/
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|
#ifndef __STM32F1_RTC_H__
|
||||||
|
#define __STM32F1_RTC_H__
|
||||||
|
|
||||||
|
void rt_hw_rtc_init(void);
|
||||||
|
|
||||||
|
#endif
|
||||||
|
|
@ -13,6 +13,7 @@
|
||||||
* 2010-03-29 Bernard remove interrupt Tx and DMA Rx mode
|
* 2010-03-29 Bernard remove interrupt Tx and DMA Rx mode
|
||||||
* 2013-05-13 aozima update for kehong-lingtai.
|
* 2013-05-13 aozima update for kehong-lingtai.
|
||||||
* 2015-01-31 armink make sure the serial transmit complete in putc()
|
* 2015-01-31 armink make sure the serial transmit complete in putc()
|
||||||
|
* 2018-08-17 whj add to usart3
|
||||||
*/
|
*/
|
||||||
|
|
||||||
#include "stm32f10x.h"
|
#include "stm32f10x.h"
|
||||||
|
|
@ -38,6 +39,11 @@
|
||||||
#define UART2_GPIO GPIOA
|
#define UART2_GPIO GPIOA
|
||||||
#endif
|
#endif
|
||||||
|
|
||||||
|
/* USART3_REMAP = 1 */
|
||||||
|
#define UART3_GPIO_TX GPIO_Pin_10
|
||||||
|
#define UART3_GPIO_RX GPIO_Pin_11
|
||||||
|
#define UART3_GPIO GPIOC
|
||||||
|
|
||||||
/* STM32 uart driver */
|
/* STM32 uart driver */
|
||||||
struct stm32_uart
|
struct stm32_uart
|
||||||
{
|
{
|
||||||
|
|
@ -184,7 +190,7 @@ void USART1_IRQHandler(void)
|
||||||
}
|
}
|
||||||
if (USART_GetFlagStatus(uart->uart_device, USART_FLAG_ORE) == SET)
|
if (USART_GetFlagStatus(uart->uart_device, USART_FLAG_ORE) == SET)
|
||||||
{
|
{
|
||||||
USART_ReceiveData(uart->uart_device);
|
stm32_getc(&serial1);
|
||||||
}
|
}
|
||||||
/* leave interrupt */
|
/* leave interrupt */
|
||||||
rt_interrupt_leave();
|
rt_interrupt_leave();
|
||||||
|
|
@ -221,7 +227,7 @@ void USART2_IRQHandler(void)
|
||||||
}
|
}
|
||||||
if (USART_GetFlagStatus(uart->uart_device, USART_FLAG_ORE) == SET)
|
if (USART_GetFlagStatus(uart->uart_device, USART_FLAG_ORE) == SET)
|
||||||
{
|
{
|
||||||
USART_ReceiveData(uart->uart_device);
|
stm32_getc(&serial2);
|
||||||
}
|
}
|
||||||
|
|
||||||
/* leave interrupt */
|
/* leave interrupt */
|
||||||
|
|
@ -229,6 +235,44 @@ void USART2_IRQHandler(void)
|
||||||
}
|
}
|
||||||
#endif /* RT_USING_UART2 */
|
#endif /* RT_USING_UART2 */
|
||||||
|
|
||||||
|
#if defined(RT_USING_UART3)
|
||||||
|
/* UART1 device driver structure */
|
||||||
|
struct stm32_uart uart3 =
|
||||||
|
{
|
||||||
|
USART3,
|
||||||
|
USART3_IRQn,
|
||||||
|
};
|
||||||
|
struct rt_serial_device serial3;
|
||||||
|
|
||||||
|
void USART3_IRQHandler(void)
|
||||||
|
{
|
||||||
|
struct stm32_uart* uart;
|
||||||
|
|
||||||
|
uart = &uart3;
|
||||||
|
|
||||||
|
/* enter interrupt */
|
||||||
|
rt_interrupt_enter();
|
||||||
|
if(USART_GetITStatus(uart->uart_device, USART_IT_RXNE) != RESET)
|
||||||
|
{
|
||||||
|
rt_hw_serial_isr(&serial3, RT_SERIAL_EVENT_RX_IND);
|
||||||
|
/* clear interrupt */
|
||||||
|
USART_ClearITPendingBit(uart->uart_device, USART_IT_RXNE);
|
||||||
|
}
|
||||||
|
if (USART_GetITStatus(uart->uart_device, USART_IT_TC) != RESET)
|
||||||
|
{
|
||||||
|
/* clear interrupt */
|
||||||
|
USART_ClearITPendingBit(uart->uart_device, USART_IT_TC);
|
||||||
|
}
|
||||||
|
if (USART_GetFlagStatus(uart->uart_device, USART_FLAG_ORE) == SET)
|
||||||
|
{
|
||||||
|
stm32_getc(&serial3);
|
||||||
|
}
|
||||||
|
|
||||||
|
/* leave interrupt */
|
||||||
|
rt_interrupt_leave();
|
||||||
|
}
|
||||||
|
#endif /* RT_USING_UART3 */
|
||||||
|
|
||||||
static void RCC_Configuration(void)
|
static void RCC_Configuration(void)
|
||||||
{
|
{
|
||||||
RCC_APB2PeriphClockCmd(RCC_APB2Periph_AFIO, ENABLE);
|
RCC_APB2PeriphClockCmd(RCC_APB2Periph_AFIO, ENABLE);
|
||||||
|
|
@ -252,6 +296,11 @@ static void RCC_Configuration(void)
|
||||||
|
|
||||||
RCC_APB1PeriphClockCmd(RCC_APB1Periph_USART2, ENABLE);
|
RCC_APB1PeriphClockCmd(RCC_APB1Periph_USART2, ENABLE);
|
||||||
#endif /* RT_USING_UART2 */
|
#endif /* RT_USING_UART2 */
|
||||||
|
|
||||||
|
#if defined(RT_USING_UART3)
|
||||||
|
RCC_APB2PeriphClockCmd(RCC_APB2Periph_AFIO | RCC_APB2Periph_GPIOC, ENABLE);
|
||||||
|
GPIO_PinRemapConfig(GPIO_PartialRemap_USART3, ENABLE);
|
||||||
|
#endif /* RT_USING_UART3 */
|
||||||
}
|
}
|
||||||
|
|
||||||
static void GPIO_Configuration(void)
|
static void GPIO_Configuration(void)
|
||||||
|
|
@ -281,6 +330,18 @@ static void GPIO_Configuration(void)
|
||||||
GPIO_InitStructure.GPIO_Pin = UART2_GPIO_TX;
|
GPIO_InitStructure.GPIO_Pin = UART2_GPIO_TX;
|
||||||
GPIO_Init(UART2_GPIO, &GPIO_InitStructure);
|
GPIO_Init(UART2_GPIO, &GPIO_InitStructure);
|
||||||
#endif /* RT_USING_UART2 */
|
#endif /* RT_USING_UART2 */
|
||||||
|
|
||||||
|
#if defined(RT_USING_UART3)
|
||||||
|
/* Configure USART3 Rx (PC.11) as input floating */
|
||||||
|
GPIO_InitStructure.GPIO_Mode = GPIO_Mode_IN_FLOATING;
|
||||||
|
GPIO_InitStructure.GPIO_Pin = UART3_GPIO_RX;
|
||||||
|
GPIO_Init(UART3_GPIO, &GPIO_InitStructure);
|
||||||
|
|
||||||
|
/* Configure USART3 Tx (PC.10) as alternate function push-pull */
|
||||||
|
GPIO_InitStructure.GPIO_Mode = GPIO_Mode_AF_PP;
|
||||||
|
GPIO_InitStructure.GPIO_Pin = UART3_GPIO_TX;
|
||||||
|
GPIO_Init(UART3_GPIO, &GPIO_InitStructure);
|
||||||
|
#endif /* RT_USING_UART3 */
|
||||||
}
|
}
|
||||||
|
|
||||||
static void NVIC_Configuration(struct stm32_uart* uart)
|
static void NVIC_Configuration(struct stm32_uart* uart)
|
||||||
|
|
@ -327,9 +388,24 @@ void rt_hw_usart_init(void)
|
||||||
|
|
||||||
NVIC_Configuration(&uart2);
|
NVIC_Configuration(&uart2);
|
||||||
|
|
||||||
/* register UART1 device */
|
/* register UART2 device */
|
||||||
rt_hw_serial_register(&serial2, "uart2",
|
rt_hw_serial_register(&serial2, "uart2",
|
||||||
RT_DEVICE_FLAG_RDWR | RT_DEVICE_FLAG_INT_RX,
|
RT_DEVICE_FLAG_RDWR | RT_DEVICE_FLAG_INT_RX,
|
||||||
uart);
|
uart);
|
||||||
#endif /* RT_USING_UART2 */
|
#endif /* RT_USING_UART2 */
|
||||||
|
|
||||||
|
#if defined(RT_USING_UART3)
|
||||||
|
uart = &uart3;
|
||||||
|
|
||||||
|
config.baud_rate = BAUD_RATE_115200;
|
||||||
|
serial2.ops = &stm32_uart_ops;
|
||||||
|
serial2.config = config;
|
||||||
|
|
||||||
|
NVIC_Configuration(&uart3);
|
||||||
|
|
||||||
|
/* register UART3 device */
|
||||||
|
rt_hw_serial_register(&serial3, "uart3",
|
||||||
|
RT_DEVICE_FLAG_RDWR | RT_DEVICE_FLAG_INT_RX,
|
||||||
|
uart);
|
||||||
|
#endif /* RT_USING_UART3 */
|
||||||
}
|
}
|
||||||
|
|
|
||||||
File diff suppressed because it is too large
Load Diff
|
|
@ -1,158 +1,207 @@
|
||||||
/* RT-Thread config file */
|
#ifndef RT_CONFIG_H__
|
||||||
#ifndef __RTTHREAD_CFG_H__
|
#define RT_CONFIG_H__
|
||||||
#define __RTTHREAD_CFG_H__
|
|
||||||
|
/* Automatically generated file; DO NOT EDIT. */
|
||||||
|
/* RT-Thread Configuration */
|
||||||
|
|
||||||
|
/* RT-Thread Kernel */
|
||||||
|
|
||||||
/* RT_NAME_MAX*/
|
|
||||||
#define RT_NAME_MAX 8
|
#define RT_NAME_MAX 8
|
||||||
|
#define RT_ALIGN_SIZE 4
|
||||||
/* RT_ALIGN_SIZE*/
|
#define RT_THREAD_PRIORITY_32
|
||||||
#define RT_ALIGN_SIZE 8
|
|
||||||
|
|
||||||
/* PRIORITY_MAX */
|
|
||||||
#define RT_THREAD_PRIORITY_MAX 32
|
#define RT_THREAD_PRIORITY_MAX 32
|
||||||
|
#define RT_TICK_PER_SECOND 1000
|
||||||
/* Tick per Second */
|
|
||||||
#define RT_TICK_PER_SECOND 100
|
|
||||||
|
|
||||||
/* SECTION: RT_DEBUG */
|
|
||||||
/* Thread Debug */
|
|
||||||
#define RT_DEBUG
|
|
||||||
#define RT_THREAD_DEBUG
|
|
||||||
|
|
||||||
#define RT_USING_OVERFLOW_CHECK
|
#define RT_USING_OVERFLOW_CHECK
|
||||||
|
|
||||||
/* Using Hook */
|
|
||||||
#define RT_USING_HOOK
|
#define RT_USING_HOOK
|
||||||
|
#define RT_IDEL_HOOK_LIST_SIZE 4
|
||||||
|
#define IDLE_THREAD_STACK_SIZE 256
|
||||||
|
#define RT_DEBUG
|
||||||
|
|
||||||
/* Using Software Timer */
|
/* Inter-Thread communication */
|
||||||
/* #define RT_USING_TIMER_SOFT */
|
|
||||||
#define RT_TIMER_THREAD_PRIO 4
|
|
||||||
#define RT_TIMER_THREAD_STACK_SIZE 512
|
|
||||||
|
|
||||||
/* SECTION: IPC */
|
|
||||||
/* Using Semaphore*/
|
|
||||||
#define RT_USING_SEMAPHORE
|
#define RT_USING_SEMAPHORE
|
||||||
|
|
||||||
/* Using Mutex */
|
|
||||||
#define RT_USING_MUTEX
|
#define RT_USING_MUTEX
|
||||||
|
|
||||||
/* Using Event */
|
|
||||||
#define RT_USING_EVENT
|
#define RT_USING_EVENT
|
||||||
|
|
||||||
/* Using MailBox */
|
|
||||||
#define RT_USING_MAILBOX
|
#define RT_USING_MAILBOX
|
||||||
|
|
||||||
/* Using Message Queue */
|
|
||||||
#define RT_USING_MESSAGEQUEUE
|
#define RT_USING_MESSAGEQUEUE
|
||||||
|
|
||||||
/* SECTION: Memory Management */
|
/* Memory Management */
|
||||||
/* Using Memory Pool Management*/
|
|
||||||
#define RT_USING_MEMPOOL
|
|
||||||
|
|
||||||
/* Using Dynamic Heap Management */
|
#define RT_USING_MEMPOOL
|
||||||
|
#define RT_USING_MEMHEAP
|
||||||
|
#define RT_USING_SMALL_MEM
|
||||||
#define RT_USING_HEAP
|
#define RT_USING_HEAP
|
||||||
|
|
||||||
/* Using Small MM */
|
/* Kernel Device Object */
|
||||||
#define RT_USING_SMALL_MEM
|
|
||||||
|
|
||||||
/* SECTION: Device System */
|
|
||||||
/* Using Device System */
|
|
||||||
#define RT_USING_DEVICE
|
#define RT_USING_DEVICE
|
||||||
// <bool name="RT_USING_DEVICE_IPC" description="Using device communication" default="true" />
|
|
||||||
#define RT_USING_DEVICE_IPC
|
|
||||||
// <bool name="RT_USING_SERIAL" description="Using Serial" default="true" />
|
|
||||||
#define RT_USING_SERIAL
|
|
||||||
|
|
||||||
#define RT_USING_SPI
|
|
||||||
|
|
||||||
/* SECTION: Console options */
|
|
||||||
#define RT_USING_CONSOLE
|
#define RT_USING_CONSOLE
|
||||||
/* the buffer size of console*/
|
|
||||||
#define RT_CONSOLEBUF_SIZE 128
|
#define RT_CONSOLEBUF_SIZE 128
|
||||||
|
#define RT_CONSOLE_DEVICE_NAME "uart2"
|
||||||
|
#define ARCH_ARM
|
||||||
|
#define ARCH_ARM_CORTEX_M
|
||||||
|
#define ARCH_ARM_CORTEX_M3
|
||||||
|
|
||||||
// <string name="RT_CONSOLE_DEVICE_NAME" description="console device name" default="uart3" />
|
/* RT-Thread Components */
|
||||||
#define RT_CONSOLE_DEVICE_NAME "uart1"
|
|
||||||
// </section>
|
|
||||||
|
|
||||||
// <section name="RT_USING_COMPONENTS_INIT" description="Using components init" default="false" >
|
#define RT_USING_COMPONENTS_INIT
|
||||||
// #define RT_USING_COMPONENTS_INIT
|
|
||||||
// </section>
|
/* C++ features */
|
||||||
|
|
||||||
|
|
||||||
|
/* Command shell */
|
||||||
|
|
||||||
/* SECTION: finsh, a C-Express shell */
|
|
||||||
#define RT_USING_FINSH
|
#define RT_USING_FINSH
|
||||||
/* Using symbol table */
|
#define FINSH_THREAD_NAME "tshell"
|
||||||
|
#define FINSH_USING_HISTORY
|
||||||
|
#define FINSH_HISTORY_LINES 5
|
||||||
#define FINSH_USING_SYMTAB
|
#define FINSH_USING_SYMTAB
|
||||||
#define FINSH_USING_DESCRIPTION
|
#define FINSH_USING_DESCRIPTION
|
||||||
|
#define FINSH_THREAD_PRIORITY 20
|
||||||
|
#define FINSH_THREAD_STACK_SIZE 4096
|
||||||
|
#define FINSH_CMD_SIZE 80
|
||||||
|
#define FINSH_USING_MSH
|
||||||
|
#define FINSH_USING_MSH_DEFAULT
|
||||||
|
#define FINSH_ARG_MAX 10
|
||||||
|
|
||||||
|
/* Device virtual file system */
|
||||||
|
|
||||||
/* SECTION: device filesystem */
|
|
||||||
#define RT_USING_DFS
|
#define RT_USING_DFS
|
||||||
#define RT_USING_DFS_ELMFAT
|
#define DFS_USING_WORKDIR
|
||||||
/* Reentrancy (thread safe) of the FatFs module. */
|
|
||||||
#define RT_DFS_ELM_REENTRANT
|
|
||||||
/* Number of volumes (logical drives) to be used. */
|
|
||||||
#define RT_DFS_ELM_DRIVES 2
|
|
||||||
/* #define RT_DFS_ELM_USE_LFN 1 */
|
|
||||||
#define RT_DFS_ELM_MAX_LFN 255
|
|
||||||
/* Maximum sector size to be handled. */
|
|
||||||
#define RT_DFS_ELM_MAX_SECTOR_SIZE 512
|
|
||||||
|
|
||||||
/* the max number of mounted filesystem */
|
|
||||||
#define DFS_FILESYSTEMS_MAX 2
|
#define DFS_FILESYSTEMS_MAX 2
|
||||||
/* the max number of opened files */
|
#define DFS_FILESYSTEM_TYPES_MAX 2
|
||||||
#define DFS_FD_MAX 4
|
#define DFS_FD_MAX 16
|
||||||
|
#define RT_USING_DFS_ELMFAT
|
||||||
|
|
||||||
/* SECTION: lwip, a lighwight TCP/IP protocol stack */
|
/* elm-chan's FatFs, Generic FAT Filesystem Module */
|
||||||
#define RT_USING_LWIP
|
|
||||||
/* Enable ICMP protocol*/
|
|
||||||
#define RT_LWIP_ICMP
|
|
||||||
/* Enable UDP protocol*/
|
|
||||||
#define RT_LWIP_UDP
|
|
||||||
/* Enable TCP protocol*/
|
|
||||||
#define RT_LWIP_TCP
|
|
||||||
/* Enable DNS */
|
|
||||||
#define RT_LWIP_DNS
|
|
||||||
|
|
||||||
/* the number of simulatenously active TCP connections*/
|
#define RT_DFS_ELM_CODE_PAGE 437
|
||||||
#define RT_LWIP_TCP_PCB_NUM 5
|
#define RT_DFS_ELM_WORD_ACCESS
|
||||||
|
#define RT_DFS_ELM_USE_LFN_3
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#define RT_DFS_ELM_USE_LFN 3
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#define RT_DFS_ELM_MAX_LFN 255
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#define RT_DFS_ELM_DRIVES 2
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||||||
|
#define RT_DFS_ELM_MAX_SECTOR_SIZE 512
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#define RT_DFS_ELM_REENTRANT
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#define RT_USING_DFS_DEVFS
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||||||
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/* ip address of target */
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/* Device Drivers */
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#define RT_LWIP_IPADDR "192.168.1.30"
|
|
||||||
|
|
||||||
/* gateway address of target */
|
#define RT_USING_DEVICE_IPC
|
||||||
#define RT_LWIP_GWADDR "192.168.1.1"
|
#define RT_PIPE_BUFSZ 512
|
||||||
|
#define RT_USING_SERIAL
|
||||||
|
#define RT_USING_PIN
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||||||
|
|
||||||
/* mask address of target */
|
/* Using USB */
|
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#define RT_LWIP_MSKADDR "255.255.255.0"
|
|
||||||
|
|
||||||
/* tcp thread options */
|
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#define RT_LWIP_TCPTHREAD_PRIORITY 12
|
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#define RT_LWIP_TCPTHREAD_MBOX_SIZE 4
|
|
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#define RT_LWIP_TCPTHREAD_STACKSIZE 1024
|
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||||||
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||||||
/* ethernet if thread options */
|
/* POSIX layer and C standard library */
|
||||||
#define RT_LWIP_ETHTHREAD_PRIORITY 15
|
|
||||||
#define RT_LWIP_ETHTHREAD_MBOX_SIZE 4
|
|
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#define RT_LWIP_ETHTHREAD_STACKSIZE 512
|
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||||||
|
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/* TCP sender buffer space */
|
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#define RT_LWIP_TCP_SND_BUF 8192
|
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/* TCP receive window. */
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#define RT_LWIP_TCP_WND 8192
|
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#define CHECKSUM_CHECK_TCP 0
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#define CHECKSUM_CHECK_IP 0
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#define CHECKSUM_CHECK_UDP 0
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#define CHECKSUM_GEN_TCP 0
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#define CHECKSUM_GEN_IP 0
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#define CHECKSUM_GEN_UDP 0
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// <bool name="RT_USING_CMSIS_OS" description="Using CMSIS OS API" default="true" />
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// #define RT_USING_CMSIS_OS
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// <bool name="RT_USING_RTT_CMSIS" description="Using CMSIS in RTT" default="true" />
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#define RT_USING_RTT_CMSIS
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||||||
// <bool name="RT_USING_BSP_CMSIS" description="Using CMSIS in BSP" default="true" />
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// #define RT_USING_BSP_CMSIS
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#define RT_USING_LIBC
|
#define RT_USING_LIBC
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/* Network */
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/* Socket abstraction layer */
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/* light weight TCP/IP stack */
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#define RT_USING_LWIP
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#define RT_USING_LWIP202
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#define RT_LWIP_IGMP
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#define RT_LWIP_ICMP
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#define RT_LWIP_DNS
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#define RT_LWIP_DHCP
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#define IP_SOF_BROADCAST 1
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#define IP_SOF_BROADCAST_RECV 1
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/* Static IPv4 Address */
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#define RT_LWIP_IPADDR "192.168.1.30"
|
||||||
|
#define RT_LWIP_GWADDR "192.168.1.1"
|
||||||
|
#define RT_LWIP_MSKADDR "255.255.255.0"
|
||||||
|
#define RT_LWIP_UDP
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|
#define RT_LWIP_TCP
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|
#define RT_MEMP_NUM_NETCONN 8
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|
#define RT_LWIP_PBUF_NUM 16
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|
#define RT_LWIP_RAW_PCB_NUM 4
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#define RT_LWIP_UDP_PCB_NUM 4
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#define RT_LWIP_TCP_PCB_NUM 4
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#define RT_LWIP_TCP_SEG_NUM 40
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|
#define RT_LWIP_TCP_SND_BUF 8196
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|
#define RT_LWIP_TCP_WND 8196
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|
#define RT_LWIP_TCPTHREAD_PRIORITY 10
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|
#define RT_LWIP_TCPTHREAD_MBOX_SIZE 8
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#define RT_LWIP_TCPTHREAD_STACKSIZE 1024
|
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|
#define RT_LWIP_ETHTHREAD_PRIORITY 12
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|
#define RT_LWIP_ETHTHREAD_STACKSIZE 1024
|
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|
#define RT_LWIP_ETHTHREAD_MBOX_SIZE 8
|
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|
#define LWIP_NETIF_STATUS_CALLBACK 1
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|
#define SO_REUSE 1
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|
#define LWIP_SO_RCVTIMEO 1
|
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|
#define LWIP_SO_SNDTIMEO 1
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|
#define LWIP_SO_RCVBUF 1
|
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|
#define LWIP_NETIF_LOOPBACK 0
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/* Modbus master and slave stack */
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/* AT commands */
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/* VBUS(Virtual Software BUS) */
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/* Utilities */
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/* ARM CMSIS */
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#define RT_USING_RTT_CMSIS
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/* RT-Thread online packages */
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/* IoT - internet of things */
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/* Wi-Fi */
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/* Marvell WiFi */
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/* Wiced WiFi */
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/* IoT Cloud */
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/* security packages */
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/* language packages */
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/* multimedia packages */
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/* tools packages */
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/* system packages */
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/* peripheral libraries and drivers */
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/* miscellaneous packages */
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/* sample package */
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/* example package: hello */
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#define SOC_STM32F1
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#define RT_USING_UART2
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#endif
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#endif
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