Merge pull request #3392 from bigmagic123/fix_mmu
[bsp/raspi3] raspi3 mmu
This commit is contained in:
Bernard Xiong
GitHub
commit
5482794956
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@ -7,7 +7,6 @@ src = Split('''
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board.c
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board.c
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bcm283x.c
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bcm283x.c
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drv_uart.c
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drv_uart.c
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mbox.c
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''')
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''')
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||||||
CPPPATH = [cwd]
|
CPPPATH = [cwd]
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||||||
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@ -16,6 +16,7 @@
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||||||
#include "drv_timer.h"
|
#include "drv_timer.h"
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#include "cp15.h"
|
#include "cp15.h"
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#include "mmu.h"
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#ifdef RT_USING_SMP
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#ifdef RT_USING_SMP
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||||||
extern void rt_hw_ipi_handler_install(int ipi_vector, rt_isr_handler_t ipi_isr_handler);
|
extern void rt_hw_ipi_handler_install(int ipi_vector, rt_isr_handler_t ipi_isr_handler);
|
||||||
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@ -57,156 +58,17 @@ void idle_wfi(void)
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asm volatile ("wfi");
|
asm volatile ("wfi");
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}
|
}
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||||||
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||||||
#define MMU_LEVEL_MASK 0x1ffUL
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#define MMU_MAP_ERROR_VANOTALIGN -1
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#define MMU_MAP_ERROR_PANOTALIGN -2
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#define MMU_MAP_ERROR_NOPAGE -3
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#define MMU_MAP_ERROR_CONFLICT -4
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unsigned char main_tbl[4096] __attribute__((aligned (4096)));
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unsigned char __page_start[4096*100] __attribute__((aligned (4096)));
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unsigned long __page_off = 0;
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unsigned long get_free_page(void) {
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__page_off += 4096;
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return (unsigned long)(__page_start + __page_off - 4096);
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}
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#define MEM_ATTR_MEM ((0x1UL << 10) | (0x2UL << 8) | (0x0UL << 6) | (0x1UL << 2))
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#define MEM_ATTR_IO ((0x1UL << 10) | (0x2UL << 8) | (0x0UL << 6) | (0x2UL << 2))
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static int map_single_page_2M(unsigned long* lv0_tbl, unsigned long va, unsigned long pa, unsigned long attr) {
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int level;
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unsigned long* cur_lv_tbl = lv0_tbl;
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unsigned long page;
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unsigned long off;
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int level_shift = 39;
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if (va & (0x200000UL - 1)) {
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return MMU_MAP_ERROR_VANOTALIGN;
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}
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if (pa & (0x200000UL - 1)) {
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return MMU_MAP_ERROR_PANOTALIGN;
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}
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for (level = 0; level < 2; level++) {
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off = (va >> level_shift);
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off &= MMU_LEVEL_MASK;
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||||||
if ((cur_lv_tbl[off] & 1) == 0) {
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page = get_free_page();
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if (!page) {
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return MMU_MAP_ERROR_NOPAGE;
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}
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rt_memset((void *)page, 0, 4096);
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||||||
cur_lv_tbl[off] = page | 0x3UL;
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}
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||||||
page = cur_lv_tbl[off];
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||||||
if (!(page & 0x2)) {
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//is block! error!
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||||||
return MMU_MAP_ERROR_CONFLICT;
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||||||
}
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||||||
cur_lv_tbl = (unsigned long*)(page & 0x0000fffffffff000UL);
|
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||||||
level_shift -= 9;
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||||||
}
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||||||
attr &= 0xfff0000000000ffcUL;
|
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pa |= (attr | 0x1UL); //block
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off = (va >> 21);
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off &= MMU_LEVEL_MASK;
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cur_lv_tbl[off] = pa;
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||||||
return 0;
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}
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||||||
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||||||
int armv8_map_2M(unsigned long* lv0_tbl, unsigned long va, unsigned long pa, int count, unsigned long attr)
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{
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||||||
int i;
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int ret;
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||||||
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||||||
if (va & (0x200000 - 1))
|
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||||||
{
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||||||
return -1;
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||||||
}
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||||||
if (pa & (0x200000 - 1))
|
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||||||
{
|
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||||||
return -1;
|
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||||||
}
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||||||
for (i = 0; i < count; i++)
|
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||||||
{
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||||||
ret = map_single_page_2M(lv0_tbl, va, pa, attr);
|
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||||||
va += 0x200000;
|
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||||||
pa += 0x200000;
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||||||
if (ret != 0)
|
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||||||
{
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||||||
return ret;
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}
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||||||
}
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||||||
return 0;
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||||||
}
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||||||
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||||||
/**
|
/**
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||||||
* Initialize the Hardware related stuffs. Called from rtthread_startup()
|
* Initialize the Hardware related stuffs. Called from rtthread_startup()
|
||||||
* after interrupt disabled.
|
* after interrupt disabled.
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||||||
*/
|
*/
|
||||||
void rt_hw_board_init(void)
|
void rt_hw_board_init(void)
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||||||
{
|
{
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||||||
/* mmu set */
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mmu_init();
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||||||
unsigned long val64;
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armv8_map(0, 0, 0x800000, MEM_ATTR_MEMORY);
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||||||
unsigned long val32; //val32不是uint32_t,val32只是表示相关的那个寄存器是32位的
|
armv8_map(0x3f00B000, 0x3f00B000, 0x1000, MEM_ATTR_IO);//timer
|
||||||
int ret;
|
armv8_map(0x3f200000, 0x3f200000, 0x16000, MEM_ATTR_IO);//uart
|
||||||
|
mmu_enable();
|
||||||
val64 = 0x007f6eUL;
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||||||
asm volatile("msr MAIR_EL1, %0\n dsb sy\n"::"r"(val64));
|
|
||||||
asm volatile("mrs %0, MAIR_EL1\n dsb sy\n":"=r"(val64));
|
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||||||
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||||||
//TCR_EL1
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||||||
val32 = (16UL << 0)
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| (0x0UL << 6)
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||||||
| (0x0UL << 7)
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||||||
| (0x3UL << 8)
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||||||
| (0x3UL << 10)
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||||||
| (0x2UL << 12)
|
|
||||||
| (0x0UL << 14)
|
|
||||||
| (0x0UL << 16)
|
|
||||||
| (0x0UL << 22)
|
|
||||||
| (0x1UL << 23)
|
|
||||||
| (0x2UL << 30)
|
|
||||||
| (0x1UL << 32)
|
|
||||||
| (0x0UL << 35)
|
|
||||||
| (0x0UL << 36)
|
|
||||||
| (0x0UL << 37)
|
|
||||||
| (0x0UL << 38);
|
|
||||||
asm volatile("msr TCR_EL1, %0\n"::"r"(val32));
|
|
||||||
asm volatile("mrs %0, TCR_EL1\n":"=r"(val32));
|
|
||||||
|
|
||||||
asm volatile("msr TTBR0_EL1, %0\n dsb sy\n"::"r"(main_tbl));
|
|
||||||
asm volatile("mrs %0, TTBR0_EL1\n dsb sy\n":"=r"(val64));
|
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||||||
|
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||||||
rt_memset(main_tbl, 0, 4096);
|
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||||||
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||||||
ret = armv8_map_2M((unsigned long *)main_tbl, 0x0, 0x0, 32, MEM_ATTR_MEM); //32*2M = 64M
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||||||
if (ret)
|
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||||||
{
|
|
||||||
goto skip_mmu;
|
|
||||||
}
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||||||
ret = armv8_map_2M((unsigned long *)main_tbl, 0x3f000000, 0x3f000000, 8, MEM_ATTR_IO); //8*2M = 16M
|
|
||||||
if (ret)
|
|
||||||
{
|
|
||||||
goto skip_mmu;
|
|
||||||
}
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||||||
|
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||||||
//关闭指令cache
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|
||||||
__asm__ volatile("mrs %0, SCTLR_EL1\n":"=r"(val64));
|
|
||||||
val64 &= ~0x1000; //disable I
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||||||
__asm__ volatile("dmb sy\n msr SCTLR_EL1, %0\n isb sy\n"::"r"(val64));
|
|
||||||
|
|
||||||
//清除指令cache
|
|
||||||
__asm__ volatile("IC IALLUIS\n dsb sy\n isb sy\n");
|
|
||||||
//清除tlb
|
|
||||||
__asm__ volatile("tlbi vmalle1\n dsb sy\n isb sy\n");
|
|
||||||
|
|
||||||
//SCTLR_EL1, turn on mmu
|
|
||||||
asm volatile("mrs %0, SCTLR_EL1\n":"=r"(val32));
|
|
||||||
val32 |= 0x1005; //enable mmu, I C M
|
|
||||||
asm volatile("dmb sy\n msr SCTLR_EL1, %0\nisb sy\n"::"r"(val32));
|
|
||||||
|
|
||||||
skip_mmu:
|
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||||||
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||||||
/* initialize hardware interrupt */
|
/* initialize hardware interrupt */
|
||||||
rt_hw_interrupt_init(); // in libcpu/interrupt.c. Set some data structures, no operation on device
|
rt_hw_interrupt_init(); // in libcpu/interrupt.c. Set some data structures, no operation on device
|
||||||
|
|
@ -232,7 +94,7 @@ skip_mmu:
|
||||||
#ifdef RT_USING_COMPONENTS_INIT
|
#ifdef RT_USING_COMPONENTS_INIT
|
||||||
rt_components_board_init();
|
rt_components_board_init();
|
||||||
#endif
|
#endif
|
||||||
rt_kprintf("__page_off = %x\n", __page_off);
|
|
||||||
}
|
}
|
||||||
|
|
||||||
#ifdef RT_USING_SMP
|
#ifdef RT_USING_SMP
|
||||||
|
|
|
||||||
|
|
@ -5,182 +5,269 @@
|
||||||
*
|
*
|
||||||
* Change Logs:
|
* Change Logs:
|
||||||
* Date Author Notes
|
* Date Author Notes
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||||||
* 2012-01-10 bernard porting to AM1808
|
* 2020-02-20 bigmagic first version
|
||||||
* 2019-07-28 zdzn add smp support
|
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||||||
*/
|
*/
|
||||||
|
#include <mmu.h>
|
||||||
|
#include <stddef.h>
|
||||||
|
|
||||||
#include "mmu.h"
|
#define TTBR_CNP 1
|
||||||
|
|
||||||
/* dump 2nd level page table */
|
typedef unsigned long int uint64_t;
|
||||||
void rt_hw_cpu_dump_page_table_2nd(rt_uint32_t *ptb)
|
|
||||||
{
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|
||||||
int i;
|
|
||||||
int fcnt = 0;
|
|
||||||
|
|
||||||
for (i = 0; i < 256; i++)
|
static unsigned long main_tbl[512 * 20] __attribute__((aligned (4096)));
|
||||||
{
|
|
||||||
rt_uint32_t pte2 = ptb[i];
|
|
||||||
if ((pte2 & 0x3) == 0)
|
|
||||||
{
|
|
||||||
if (fcnt == 0)
|
|
||||||
rt_kprintf(" ");
|
|
||||||
rt_kprintf("%04x: ", i);
|
|
||||||
fcnt++;
|
|
||||||
if (fcnt == 16)
|
|
||||||
{
|
|
||||||
rt_kprintf("fault\n");
|
|
||||||
fcnt = 0;
|
|
||||||
}
|
|
||||||
continue;
|
|
||||||
}
|
|
||||||
if (fcnt != 0)
|
|
||||||
{
|
|
||||||
rt_kprintf("fault\n");
|
|
||||||
fcnt = 0;
|
|
||||||
}
|
|
||||||
|
|
||||||
rt_kprintf(" %04x: %x: ", i, pte2);
|
#define IS_ALIGNED(x, a) (((x) & ((typeof(x))(a) - 1)) == 0)
|
||||||
if ((pte2 & 0x3) == 0x1)
|
|
||||||
|
#define PMD_TYPE_SECT (1 << 0)
|
||||||
|
|
||||||
|
#define PMD_TYPE_TABLE (3 << 0)
|
||||||
|
|
||||||
|
#define PTE_TYPE_PAGE (3 << 0)
|
||||||
|
|
||||||
|
#define BITS_PER_VA 39
|
||||||
|
|
||||||
|
/* Granule size of 4KB is being used */
|
||||||
|
#define GRANULE_SIZE_SHIFT 12
|
||||||
|
#define GRANULE_SIZE (1 << GRANULE_SIZE_SHIFT)
|
||||||
|
#define XLAT_ADDR_MASK ((1UL << BITS_PER_VA) - GRANULE_SIZE)
|
||||||
|
|
||||||
|
#define PMD_TYPE_MASK (3 << 0)
|
||||||
|
|
||||||
|
int free_idx = 1;
|
||||||
|
|
||||||
|
void mmu_memset(char *dst, char v, size_t len)
|
||||||
{
|
{
|
||||||
rt_kprintf("L,ap:%x,xn:%d,texcb:%02x\n",
|
while (len--)
|
||||||
((pte2 >> 7) | (pte2 >> 4))& 0xf,
|
|
||||||
(pte2 >> 15) & 0x1,
|
|
||||||
((pte2 >> 10) | (pte2 >> 2)) & 0x1f);
|
|
||||||
}
|
|
||||||
else
|
|
||||||
{
|
{
|
||||||
rt_kprintf("S,ap:%x,xn:%d,texcb:%02x\n",
|
*dst++ = v;
|
||||||
((pte2 >> 7) | (pte2 >> 4))& 0xf, pte2 & 0x1,
|
|
||||||
((pte2 >> 4) | (pte2 >> 2)) & 0x1f);
|
|
||||||
}
|
|
||||||
}
|
}
|
||||||
}
|
}
|
||||||
|
|
||||||
void rt_hw_cpu_dump_page_table(rt_uint32_t *ptb)
|
static unsigned long __page_off = 0;
|
||||||
|
static unsigned long get_free_page(void)
|
||||||
{
|
{
|
||||||
int i;
|
__page_off += 512;
|
||||||
int fcnt = 0;
|
return (unsigned long)(main_tbl + __page_off);
|
||||||
|
|
||||||
rt_kprintf("page table@%p\n", ptb);
|
|
||||||
for (i = 0; i < 1024*4; i++)
|
|
||||||
{
|
|
||||||
rt_uint32_t pte1 = ptb[i];
|
|
||||||
if ((pte1 & 0x3) == 0)
|
|
||||||
{
|
|
||||||
rt_kprintf("%03x: ", i);
|
|
||||||
fcnt++;
|
|
||||||
if (fcnt == 16)
|
|
||||||
{
|
|
||||||
rt_kprintf("fault\n");
|
|
||||||
fcnt = 0;
|
|
||||||
}
|
|
||||||
continue;
|
|
||||||
}
|
|
||||||
if (fcnt != 0)
|
|
||||||
{
|
|
||||||
rt_kprintf("fault\n");
|
|
||||||
fcnt = 0;
|
|
||||||
}
|
}
|
||||||
|
|
||||||
rt_kprintf("%03x: %08x: ", i, pte1);
|
void mmu_init(void)
|
||||||
if ((pte1 & 0x3) == 0x3)
|
|
||||||
{
|
{
|
||||||
rt_kprintf("LPAE\n");
|
unsigned long val64;
|
||||||
}
|
unsigned long val32;
|
||||||
else if ((pte1 & 0x3) == 0x1)
|
|
||||||
{
|
val64 = 0x007f6eUL;
|
||||||
rt_kprintf("pte,ns:%d,domain:%d\n",
|
__asm__ volatile("msr MAIR_EL1, %0\n dsb sy\n"::"r"(val64));
|
||||||
(pte1 >> 3) & 0x1, (pte1 >> 5) & 0xf);
|
__asm__ volatile("mrs %0, MAIR_EL1\n dsb sy\n":"=r"(val64));
|
||||||
/*
|
|
||||||
*rt_hw_cpu_dump_page_table_2nd((void*)((pte1 & 0xfffffc000)
|
//TCR_EL1
|
||||||
* - 0x80000000 + 0xC0000000));
|
val32 = (16UL << 0)//48bit
|
||||||
*/
|
| (0x0UL << 6)
|
||||||
}
|
| (0x0UL << 7)
|
||||||
else if (pte1 & (1 << 18))
|
| (0x3UL << 8)
|
||||||
{
|
| (0x3UL << 10)//Inner Shareable
|
||||||
rt_kprintf("super section,ns:%d,ap:%x,xn:%d,texcb:%02x\n",
|
| (0x2UL << 12)
|
||||||
(pte1 >> 19) & 0x1,
|
| (0x0UL << 14)//4K
|
||||||
((pte1 >> 13) | (pte1 >> 10))& 0xf,
|
| (0x0UL << 16)
|
||||||
(pte1 >> 4) & 0x1,
|
| (0x0UL << 22)
|
||||||
((pte1 >> 10) | (pte1 >> 2)) & 0x1f);
|
| (0x1UL << 23)
|
||||||
}
|
| (0x2UL << 30)
|
||||||
else
|
| (0x1UL << 32)
|
||||||
{
|
| (0x0UL << 35)
|
||||||
rt_kprintf("section,ns:%d,ap:%x,"
|
| (0x0UL << 36)
|
||||||
"xn:%d,texcb:%02x,domain:%d\n",
|
| (0x0UL << 37)
|
||||||
(pte1 >> 19) & 0x1,
|
| (0x0UL << 38);
|
||||||
((pte1 >> 13) | (pte1 >> 10))& 0xf,
|
__asm__ volatile("msr TCR_EL1, %0\n"::"r"(val32));
|
||||||
(pte1 >> 4) & 0x1,
|
__asm__ volatile("mrs %0, TCR_EL1\n":"=r"(val32));
|
||||||
(((pte1 & (0x7 << 12)) >> 10) |
|
|
||||||
((pte1 & 0x0c) >> 2)) & 0x1f,
|
__asm__ volatile("msr TTBR0_EL1, %0\n dsb sy\n"::"r"(main_tbl));
|
||||||
(pte1 >> 5) & 0xf);
|
__asm__ volatile("mrs %0, TTBR0_EL1\n dsb sy\n":"=r"(val64));
|
||||||
}
|
|
||||||
}
|
mmu_memset((char *)main_tbl, 0, 4096);
|
||||||
}
|
}
|
||||||
|
|
||||||
/* level1 page table, each entry for 1MB memory. */
|
void mmu_enable(void)
|
||||||
volatile static unsigned long MMUTable[4*1024] __attribute__((aligned(16*1024)));
|
|
||||||
void rt_hw_mmu_setmtt(rt_uint32_t vaddrStart,
|
|
||||||
rt_uint32_t vaddrEnd,
|
|
||||||
rt_uint32_t paddrStart,
|
|
||||||
rt_uint32_t attr)
|
|
||||||
{
|
{
|
||||||
volatile rt_uint32_t *pTT;
|
unsigned long val64;
|
||||||
volatile int i, nSec;
|
unsigned long val32;
|
||||||
pTT = (rt_uint32_t *)MMUTable + (vaddrStart >> 20);
|
|
||||||
nSec = (vaddrEnd >> 20) - (vaddrStart >> 20);
|
__asm__ volatile("mrs %0, SCTLR_EL1\n":"=r"(val64));
|
||||||
for(i = 0; i <= nSec; i++)
|
val64 &= ~0x1000; //disable I
|
||||||
{
|
__asm__ volatile("dmb sy\n msr SCTLR_EL1, %0\n isb sy\n"::"r"(val64));
|
||||||
*pTT = attr | (((paddrStart >> 20) + i) << 20);
|
|
||||||
pTT++;
|
__asm__ volatile("IC IALLUIS\n dsb sy\n isb sy\n");
|
||||||
}
|
__asm__ volatile("tlbi vmalle1\n dsb sy\n isb sy\n");
|
||||||
|
|
||||||
|
//SCTLR_EL1, turn on mmu
|
||||||
|
__asm__ volatile("mrs %0, SCTLR_EL1\n":"=r"(val32));
|
||||||
|
val32 |= 0x1005; //enable mmu, I C M
|
||||||
|
__asm__ volatile("dmb sy\n msr SCTLR_EL1, %0\nisb sy\n"::"r"(val32));
|
||||||
}
|
}
|
||||||
|
|
||||||
unsigned long rt_hw_set_domain_register(unsigned long domain_val)
|
static int map_single_page_2M(unsigned long* lv0_tbl, unsigned long va, unsigned long pa, unsigned long attr)
|
||||||
{
|
{
|
||||||
#if 0
|
int level;
|
||||||
unsigned long old_domain;
|
unsigned long* cur_lv_tbl = lv0_tbl;
|
||||||
|
unsigned long page;
|
||||||
|
unsigned long off;
|
||||||
|
int level_shift = 39;
|
||||||
|
|
||||||
asm volatile ("mrc p15, 0, %0, c3, c0\n" : "=r" (old_domain));
|
if (va & (0x200000UL - 1))
|
||||||
asm volatile ("mcr p15, 0, %0, c3, c0\n" : :"r" (domain_val) : "memory");
|
{
|
||||||
|
return MMU_MAP_ERROR_VANOTALIGN;
|
||||||
return old_domain;
|
}
|
||||||
#else
|
if (pa & (0x200000UL - 1))
|
||||||
|
{
|
||||||
|
return MMU_MAP_ERROR_PANOTALIGN;
|
||||||
|
}
|
||||||
|
for (level = 0; level < 2; level++)
|
||||||
|
{
|
||||||
|
off = (va >> level_shift);
|
||||||
|
off &= MMU_LEVEL_MASK;
|
||||||
|
if ((cur_lv_tbl[off] & 1) == 0)
|
||||||
|
{
|
||||||
|
page = get_free_page();
|
||||||
|
if (!page)
|
||||||
|
{
|
||||||
|
return MMU_MAP_ERROR_NOPAGE;
|
||||||
|
}
|
||||||
|
mmu_memset((char *)page, 0, 4096);
|
||||||
|
cur_lv_tbl[off] = page | 0x3UL;
|
||||||
|
}
|
||||||
|
page = cur_lv_tbl[off];
|
||||||
|
if (!(page & 0x2))
|
||||||
|
{
|
||||||
|
//is block! error!
|
||||||
|
return MMU_MAP_ERROR_CONFLICT;
|
||||||
|
}
|
||||||
|
cur_lv_tbl = (unsigned long*)(page & 0x0000fffffffff000UL);
|
||||||
|
level_shift -= 9;
|
||||||
|
}
|
||||||
|
attr &= 0xfff0000000000ffcUL;
|
||||||
|
pa |= (attr | 0x1UL); //block
|
||||||
|
off = (va >> 21);
|
||||||
|
off &= MMU_LEVEL_MASK;
|
||||||
|
cur_lv_tbl[off] = pa;
|
||||||
return 0;
|
return 0;
|
||||||
#endif
|
|
||||||
}
|
}
|
||||||
|
|
||||||
void rt_hw_init_mmu_table()
|
int armv8_map_2M(unsigned long va, unsigned long pa, int count, unsigned long attr)
|
||||||
{
|
{
|
||||||
/* set page table */
|
int i;
|
||||||
/* 4G 1:1 memory */
|
int ret;
|
||||||
rt_hw_mmu_setmtt(0x00000000, 0x3effffff, 0x00000000, NORMAL_MEM);
|
|
||||||
/* IO memory region */
|
|
||||||
rt_hw_mmu_setmtt(0x3f000000, 0x40010000, 0x3f000000, DEVICE_MEM);
|
|
||||||
}
|
|
||||||
|
|
||||||
void rt_hw_change_mmu_table(rt_uint32_t vaddrStart,
|
if (va & (0x200000 - 1))
|
||||||
rt_uint32_t size,
|
|
||||||
rt_uint32_t paddrStart, rt_uint32_t attr)
|
|
||||||
{
|
{
|
||||||
rt_hw_mmu_setmtt(vaddrStart, vaddrStart+size-1, paddrStart, attr);
|
return -1;
|
||||||
}
|
}
|
||||||
|
if (pa & (0x200000 - 1))
|
||||||
void rt_hw_mmu_init(void)
|
|
||||||
{
|
{
|
||||||
rt_cpu_dcache_clean_flush();
|
return -1;
|
||||||
rt_cpu_icache_flush();
|
|
||||||
rt_hw_cpu_dcache_disable();
|
|
||||||
rt_hw_cpu_icache_disable();
|
|
||||||
rt_cpu_mmu_disable();
|
|
||||||
|
|
||||||
/*rt_hw_cpu_dump_page_table(MMUTable);*/
|
|
||||||
rt_hw_set_domain_register(0x55555555);
|
|
||||||
|
|
||||||
rt_cpu_tlb_set(MMUTable);
|
|
||||||
|
|
||||||
rt_cpu_mmu_enable();
|
|
||||||
|
|
||||||
rt_hw_cpu_icache_enable();
|
|
||||||
rt_hw_cpu_dcache_enable();
|
|
||||||
}
|
}
|
||||||
|
for (i = 0; i < count; i++)
|
||||||
|
{
|
||||||
|
ret = map_single_page_2M((unsigned long *)main_tbl, va, pa, attr);
|
||||||
|
va += 0x200000;
|
||||||
|
pa += 0x200000;
|
||||||
|
if (ret != 0)
|
||||||
|
{
|
||||||
|
return ret;
|
||||||
|
}
|
||||||
|
}
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
static void set_table(uint64_t *pt, uint64_t *table_addr)
|
||||||
|
{
|
||||||
|
uint64_t val;
|
||||||
|
val = (0x3UL | (uint64_t)table_addr);
|
||||||
|
*pt = val;
|
||||||
|
}
|
||||||
|
|
||||||
|
void mmu_memset2(unsigned char *dst, char v, int len)
|
||||||
|
{
|
||||||
|
while (len--)
|
||||||
|
{
|
||||||
|
*dst++ = v;
|
||||||
|
}
|
||||||
|
}
|
||||||
|
|
||||||
|
static uint64_t *create_table(void)
|
||||||
|
{
|
||||||
|
uint64_t *new_table = (uint64_t *)((unsigned char *)&main_tbl[0] + free_idx * 4096); //+ free_idx * GRANULE_SIZE;
|
||||||
|
/* Mark all entries as invalid */
|
||||||
|
mmu_memset2((unsigned char *)new_table, 0, 4096);
|
||||||
|
free_idx++;
|
||||||
|
return new_table;
|
||||||
|
}
|
||||||
|
|
||||||
|
static int pte_type(uint64_t *pte)
|
||||||
|
{
|
||||||
|
return *pte & PMD_TYPE_MASK;
|
||||||
|
}
|
||||||
|
|
||||||
|
static int level2shift(int level)
|
||||||
|
{
|
||||||
|
/* Page is 12 bits wide, every level translates 9 bits */
|
||||||
|
return (12 + 9 * (3 - level));
|
||||||
|
}
|
||||||
|
|
||||||
|
static uint64_t *get_level_table(uint64_t *pte)
|
||||||
|
{
|
||||||
|
uint64_t *table = (uint64_t *)(*pte & XLAT_ADDR_MASK);
|
||||||
|
|
||||||
|
if (pte_type(pte) != PMD_TYPE_TABLE)
|
||||||
|
{
|
||||||
|
table = create_table();
|
||||||
|
set_table(pte, table);
|
||||||
|
}
|
||||||
|
return table;
|
||||||
|
}
|
||||||
|
|
||||||
|
static void map_region(uint64_t virt, uint64_t phys, uint64_t size, uint64_t attr)
|
||||||
|
{
|
||||||
|
uint64_t block_size = 0;
|
||||||
|
uint64_t block_shift = 0;
|
||||||
|
uint64_t *pte;
|
||||||
|
uint64_t idx = 0;
|
||||||
|
uint64_t addr = 0;
|
||||||
|
uint64_t *table = 0;
|
||||||
|
int level = 0;
|
||||||
|
|
||||||
|
addr = virt;
|
||||||
|
while (size)
|
||||||
|
{
|
||||||
|
table = &main_tbl[0];
|
||||||
|
for (level = 0; level < 4; level++)
|
||||||
|
{
|
||||||
|
block_shift = level2shift(level);
|
||||||
|
idx = addr >> block_shift;
|
||||||
|
idx = idx%512;
|
||||||
|
block_size = (uint64_t)(1L << block_shift);
|
||||||
|
pte = table + idx;
|
||||||
|
|
||||||
|
if (size >= block_size && IS_ALIGNED(addr, block_size))
|
||||||
|
{
|
||||||
|
attr &= 0xfff0000000000ffcUL;
|
||||||
|
if(level != 3)
|
||||||
|
{
|
||||||
|
*pte = phys | (attr | 0x1UL);
|
||||||
|
}
|
||||||
|
else
|
||||||
|
{
|
||||||
|
*pte = phys | (attr | 0x3UL);
|
||||||
|
}
|
||||||
|
addr += block_size;
|
||||||
|
phys += block_size;
|
||||||
|
size -= block_size;
|
||||||
|
break;
|
||||||
|
}
|
||||||
|
table = get_level_table(pte);
|
||||||
|
}
|
||||||
|
}
|
||||||
|
}
|
||||||
|
|
||||||
|
void armv8_map(unsigned long va, unsigned long pa, unsigned long size, unsigned long attr)
|
||||||
|
{
|
||||||
|
map_region(va, pa, size, attr);
|
||||||
|
}
|
||||||
|
|
||||||
|
|
|
||||||
|
|
@ -1,60 +1,31 @@
|
||||||
/*
|
/*
|
||||||
* Copyright (c) 2006-2018, RT-Thread Development Team
|
* Copyright (c) 2006-2020, RT-Thread Development Team
|
||||||
*
|
*
|
||||||
* SPDX-License-Identifier: Apache-2.0
|
* SPDX-License-Identifier: Apache-2.0
|
||||||
*
|
*
|
||||||
* Change Logs:
|
* Change Logs:
|
||||||
* Date Author Notes
|
* Date Author Notes
|
||||||
* 2020-01-15 bigmagic the first version
|
* 2020-02-20 bigmagic first version
|
||||||
*/
|
*/
|
||||||
#ifndef MMU_H__
|
|
||||||
#define MMU_H__
|
|
||||||
#include <rtthread.h>
|
|
||||||
#include <rthw.h>
|
|
||||||
#include <board.h>
|
|
||||||
#include "cp15.h"
|
|
||||||
|
|
||||||
#define DESC_SEC (0x2)
|
#ifndef __MMU_H__
|
||||||
#define CB (3<<2) //cache_on, write_back
|
#define __MMU_H__
|
||||||
#define CNB (2<<2) //cache_on, write_through
|
|
||||||
#define NCB (1<<2) //cache_off,WR_BUF on
|
|
||||||
#define NCNB (0<<2) //cache_off,WR_BUF off
|
|
||||||
#define AP_RW (3<<10) //supervisor=RW, user=RW
|
|
||||||
#define AP_RO (2<<10) //supervisor=RW, user=RO
|
|
||||||
#define XN (1<<4) // eXecute Never
|
|
||||||
#define SHARED (1<<16) /* shareable */
|
|
||||||
#define SHAREDEVICE (1<<2) /* shared device */
|
|
||||||
#define STRONGORDER (0<<2) /* strong ordered */
|
|
||||||
#define MEMWBWA ((1<<12)|(3<<2)) /* write back, write allocate */
|
|
||||||
|
|
||||||
#define DOMAIN_FAULT (0x0)
|
#define MMU_LEVEL_MASK 0x1ffUL
|
||||||
#define DOMAIN_CHK (0x1)
|
#define MMU_MAP_ERROR_VANOTALIGN -1
|
||||||
#define DOMAIN_NOTCHK (0x3)
|
#define MMU_MAP_ERROR_PANOTALIGN -2
|
||||||
#define DOMAIN0 (0x0<<5)
|
#define MMU_MAP_ERROR_NOPAGE -3
|
||||||
#define DOMAIN1 (0x1<<5)
|
#define MMU_MAP_ERROR_CONFLICT -4
|
||||||
|
|
||||||
#define DOMAIN0_ATTR (DOMAIN_CHK<<0)
|
#define MEM_ATTR_MEMORY ((0x1UL << 10) | (0x2UL << 8) | (0x0UL << 6) | (0x1UL << 2))
|
||||||
#define DOMAIN1_ATTR (DOMAIN_FAULT<<2)
|
#define MEM_ATTR_IO ((0x1UL << 10) | (0x2UL << 8) | (0x0UL << 6) | (0x2UL << 2))
|
||||||
|
|
||||||
/* Read/Write, cache, write back */
|
void mmu_init(void);
|
||||||
#define RW_CB (AP_RW|DOMAIN0|CB|DESC_SEC)
|
|
||||||
/* Read/Write, cache, write through */
|
|
||||||
#define RW_CNB (AP_RW|DOMAIN0|CNB|DESC_SEC)
|
|
||||||
/* Read/Write without cache and write buffer */
|
|
||||||
#define RW_NCNB (AP_RW|DOMAIN0|NCNB|DESC_SEC)
|
|
||||||
/* Read/Write without cache and write buffer, no execute */
|
|
||||||
#define RW_NCNBXN (AP_RW|DOMAIN0|NCNB|DESC_SEC|XN)
|
|
||||||
/* Read/Write without cache and write buffer */
|
|
||||||
#define RW_FAULT (AP_RW|DOMAIN1|NCNB|DESC_SEC)
|
|
||||||
|
|
||||||
/* device mapping type */
|
void mmu_enable(void);
|
||||||
#define DEVICE_MEM (SHARED|SHAREDEVICE|RW_NCNBXN)
|
|
||||||
/* normal memory mapping type */
|
|
||||||
#define NORMAL_MEM (SHARED|AP_RW|DOMAIN0|MEMWBWA|DESC_SEC)
|
|
||||||
#define STRONG_ORDER_MEM (SHARED|AP_RO|XN|DESC_SEC)
|
|
||||||
#define BUS_ADDRESS(phys) (((phys) & ~0xC0000000) | 0xC0000000)
|
|
||||||
|
|
||||||
void rt_hw_change_mmu_table(rt_uint32_t vaddrStart,
|
int armv8_map_2M(unsigned long va, unsigned long pa, int count, unsigned long attr);
|
||||||
rt_uint32_t size,
|
|
||||||
rt_uint32_t paddrStart, rt_uint32_t attr);
|
void armv8_map(unsigned long va, unsigned long pa, unsigned long size, unsigned long attr);
|
||||||
#endif
|
|
||||||
|
#endif /*__MMU_H__*/
|
||||||
|
|
|
||||||
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